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1. (WO2001022344) COMPARATEUR DIFFERENTIEL DOUBLE ET ARCHITECTURE DE BLOCS ANALOGIQUES PROGRAMMABLES METTANT EN OEUVRE CE COMPARATEUR
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2001/022344    N° de la demande internationale :    PCT/US2000/026180
Date de publication : 29.03.2001 Date de dépôt international : 22.09.2000
CIB :
G06G 7/06 (2006.01), H03K 5/24 (2006.01)
Déposants : LATTICE SEMICONDUCTOR CORPORATION [US/US]; 5555 N.E. Moore Court, Hillsboro, OR 97124-6421 (US)
Inventeurs : GORECKI, James, L.; (US).
GAZELEY, William, G.; (US).
YANG, Yaohua; (US)
Mandataire : ASCOLESE, Marc, R.; Skjerven Morrill MacPherson LLP, Suite 700, 25 Metro Drive, San Jose, CA 95110 (US)
Données relatives à la priorité :
60/155,512 22.09.1999 US
Titre (EN) DOUBLE DIFFERENTIAL COMPARATOR AND PROGRAMMABLE ANALOG BLOCK ARCHITECTURE USING SAME
(FR) COMPARATEUR DIFFERENTIEL DOUBLE ET ARCHITECTURE DE BLOCS ANALOGIQUES PROGRAMMABLES METTANT EN OEUVRE CE COMPARATEUR
Abrégé : front page image
(EN)A double differential comparator can be efficiently implemented utilizing a first comparator stage having a folded cascode with floating gate input terminals and clamped single-ended output, and a capacitively coupled input stage for transferring a weighted sum of input signals to the floating gates of the first comparator stage. Additionally, the double differential comparator can be integrated into fully differential programmable analog integrated circuits. Such fully differential programmable analog integrated circuits can also include a differential output digital-to-analog converter to be used with or without the double differential comparator.
(FR)Selon l'invention, on peut mettre en oeuvre un comparateur différentiel double en utilisant un premier étage de comparateur comprenant un montage cascode plié, doté de bornes d'entrée à grille flottante et d'une sortie à terminaison unique, fixée en niveau, et en utilisant un étage d'entrée, couplé de manière capacitive et destiné à transférer une somme pondérée des signaux d'entrée aux portes flottantes du premier étage du comparateur. En outre, ce comparateur différentiel double peut être intégré dans des circuits intégrés analogiques, programmables et totalement différentiels. De tels circuits peuvent également comporter un convertisseur numérique/analogique à sortie différentielle à utiliser avec ou sans ce comparateur différentiel double.
États désignés : AE, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, CA, CH, CN, CR, CU, CZ, DE, DK, DM, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, TZ, UA, UG, UZ, VN, YU, ZA, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)