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1. (WO2001013516) EGALISEUR DE RETROACTION DE DECISION ET CIRCUIT D'INTEGRATION D'UN PRECODEUR
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2001/013516    N° de la demande internationale :    PCT/US2000/022017
Date de publication : 22.02.2001 Date de dépôt international : 11.08.2000
Demande présentée en vertu du Chapitre 2 :    13.03.2001    
CIB :
H03H 21/00 (2006.01), H04L 25/03 (2006.01)
Déposants : BROADCOM CORPORATION [US/US]; 16215 Alton Parkway, Irvine, CA 92618-3616 (US) (Tous Sauf US).
JAFFE, Steven, T. [US/US]; (US) (US Seulement).
JOSHI, Robindra [US/US]; (US) (US Seulement).
JONES, David [US/US]; (US) (US Seulement).
LIN, Thuji, Simon [--/US]; (US) (US Seulement)
Inventeurs : JAFFE, Steven, T.; (US).
JOSHI, Robindra; (US).
JONES, David; (US).
LIN, Thuji, Simon; (US)
Mandataire : GELFOUND, Craig, A.; Christie, Parker & Hale, LLP, P.O. Box 7068, Pasadena, CA 91109-7068 (US)
Données relatives à la priorité :
60/148,978 13.08.1999 US
60/148,801 13.08.1999 US
09/550,757 17.04.2000 US
Titre (EN) DECISION FEEDBACK EQUALIZER AND PRECODER RAMPING CIRCUIT
(FR) EGALISEUR DE RETROACTION DE DECISION ET CIRCUIT D'INTEGRATION D'UN PRECODEUR
Abrégé : front page image
(EN)A feedforward filter (20) has a plurality of feedforward filter taps (23a-23g), including a feedforward filter reference tap (23d). The reference tap of the feedforward filter is positioned proximate a center position of the feedforward filter. A ramping circuit (604) assembly has an input port configured to receive at least one decision feedback filter tap coefficient from a decision feedback filter. A coefficient ramping circuit is configured to provide a ramped output for at least one of the decision feedback filter tap coefficients. The ramped output is varied over time from a first value to a second value. The second value is dependent upon the value of a decision feedback filter tap coefficient. An output port of the ramping circuit assembly is configured to communicate information representative of the ramped output(s) to a precoder (603).
(FR)Ce filtre de correction aval possède plusieurs prises de filtre de correction aval, notamment une prise de référence de filtre de correction aval, laquelle est placée à proximité d'une position centrale du filtre de correction aval. Un ensemble circuit d'intégration possède un port d'entrée conçu pour recevoir au moins un coefficient de prise de filtre de rétroaction de décision, à partir d'un filtre de rétroaction de décision. Un circuit d'intégration de coefficients est agencé pour produire une sortie intégrée destinée à au moins un des coefficients de prise de filtre de rétroaction de décision. Cette sortie intégrée varie en fonction du temps, entre une première et une seconde valeur, la seconde valeur dépendant de la valeur d'un coefficient de prise de filtre de rétroaction de décision. Un port de sortie de l'ensemble circuit d'intégration est conçu pour communiquer à un précodeur des informations représentatives de(s) la (les) sortie(s) intégrées.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CA, CH, CN, CR, CU, CZ, DE, DK, DM, DZ, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, TZ, UA, UG, US, UZ, VN, YU, ZA, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)