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1. (WO2000054164) INTERFACE PIPELINE A ONDES DYNAMIQUES, ET APPAREIL ET PROCEDES S'Y RAPPORTANT
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2000/054164    N° de la demande internationale :    PCT/GB2000/000756
Date de publication : 14.09.2000 Date de dépôt international : 03.03.2000
Demande présentée en vertu du Chapitre 2 :    11.09.2000    
CIB :
G06F 13/42 (2006.01), H04L 7/04 (2006.01)
Déposants : INTERNATIONAL BUSINESS MACHINES CORPORATION [US/US]; New Orchard Road, Armonk, NY 10504 (US).
IBM UNITED KINGDOM LIMITED [GB/GB]; P.O. Box 41, North Harbour, Portsmouth, Hampshire PO6 3AU (GB) (MC only)
Inventeurs : DREPS, Daniel, Mark; (US).
FERRAIOLO, Frank, David; (US).
GOWER, Kevin, Charles; (US)
Mandataire : ZERBI, Guido, Maria; IBM United Kingdom Limited Intellectual Property Law, Hursley Park, Winchester, Hampshire SO21 2JN (GB)
Données relatives à la priorité :
09/263,662 05.03.1999 US
Titre (EN) DYNAMIC WAVE-PIPELINED INTERFACE APPARATUS AND METHODS THEREFOR
(FR) INTERFACE PIPELINE A ONDES DYNAMIQUES, ET APPAREIL ET PROCEDES S'Y RAPPORTANT
Abrégé : front page image
(EN)An apparatus and method for a dynamic wave-pipelined interface are implemented. Data signals received from a sending circuit delayed via a programmable delay device corresponding to each signal before being latched into the receiving device. The programmable delay in each delay device is set according to an initialisation procedure whereby each signal is deskewed to a latest arriving signal. Additionally, a phase of an input/output (I/O) clock controlling the latching of the data signals is adjusted so that a latching transition is substantially centred in a data valid window.
(FR)Cette invention concerne un appareil et un procédé qui sont destinés à une interface pipeline à ondes dynamiques. Des signaux de données sont reçus d'un circuit d'envoi retardé par un dispositif de retard programmable correspondant à chaque signal, puis sont verrouillés dans le dispositif de réception. Le retard programmable de chaque dispositif de retard est défini en fonction d'une procédure d'initialisation, chaque signal étant réaligné au dernier signal arrivant. En outre, une phase d'une horloge d'entrée/sortie (I/O) commandant le verrouillage des signaux de données est ajustée de sorte que la transition de verrouillage soit globalement centrée dans une fenêtre de données valide.
États désignés : AE, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, CA, CH, CN, CR, CU, CZ, DE, DK, DM, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, TZ, UA, UG, UZ, VN, YU, ZA, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (GH, GM, KE, LS, MW, SD, SL, SZ, TZ, UG, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)