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1. (WO2000052826) RESSOURCES D'INTERCONNEXION ET ENTREE/SORTIE POUR DES DISPOSITIFS DE CIRCUIT INTEGRE A LOGIQUE PROGRAMMABLE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2000/052826    N° de la demande internationale :    PCT/US2000/005628
Date de publication : 08.09.2000 Date de dépôt international : 02.03.2000
CIB :
H03K 19/173 (2006.01), H03K 19/177 (2006.01)
Déposants : ALTERA CORPORATION [US/US]; 101 Innovation Drive, San Jose, CA 95134 (US)
Inventeurs : NGAI, Tony; (US).
PEDERSON, Bruce; (US).
SHUMARAYEV, Sergey; (US).
SCHLEICHER, James; (US).
HUANG, Wei-Jen; (US).
HUTTON, Michael; (US).
MARURI, Victor; (US).
PATEL, Rakesh; (US).
KAZARIAN, Peter, J.; (US).
LEAVER, Andrew; (US).
MENDEL, David, W.; (US).
PARK, Jim; (US)
Mandataire : JACKSON, Robert, R.; Fish & Neave, 1251 Avenue of the Americas, New York, NY 10020 (US)
Données relatives à la priorité :
60/122,788 04.03.1999 US
60/142,508 06.07.1999 US
60/142,513 06.07.1999 US
60/142,431 06.07.1999 US
Titre (EN) INTERCONNECTION AND INPUT/OUTPUT RESOURCES FOR PROGRAMMABLE LOGIC INTEGRATED CIRCUIT DEVICES
(FR) RESSOURCES D'INTERCONNEXION ET ENTREE/SORTIE POUR DES DISPOSITIFS DE CIRCUIT INTEGRE A LOGIQUE PROGRAMMABLE
Abrégé : front page image
(EN)A programmable logic integrated circuit device (10) has a plurality of regions (20) of programmable logic disposed on the device in a plurality of intersecting rows and columns of such regions. Interconnection resources (e.g., interconnection conductors, signal buffers/drivers, programmable connectors, etc.) are provided on the device for making programmable interconnections to, from and/or between the regions. At least some of these interconnection resources are provided in two forms that are architecturally similar (e.g., with similar and substantially parallel routing) but that have significantly different signal propagation speed characteristics. For example, a major or larger portion of such dual-form interconnection resources (200a, 210a, 230a) may have what may be termed normal signal speed, while a smaller minor portion (200b, 210b, 230b) may have significantly faster signal speed. Secondary (e.g., clock and clear) signal distribution may also be enhanced, and so may be input/output circuitry and cascade connections between adjacent or nearby logic modules on the device.
(FR)La présente invention propose un dispositif (10) de circuit intégré à logique programmable présentant une pluralité de régions (20) de logique programmable disposées sur le dispositif en une pluralité de rangées et colonnes de croisement desdites régions. Des ressources d'interconnexion (e.g. conducteurs d'interconnexion, amortisseurs/amplificateurs de signaux, connecteurs programmables et autres) sont prévues sur le dispositif pour effectuer des interconnexions à partir de, vers et/ou entre les régions. Certaines au moins de ces ressources d'interconnexions se présentent sous deux formes qui sont d'architecture semblable (e.g. ayant un acheminement similaire et parallèle) mais qui possèdent des caractéristiques de vitesse de propagation de signal considérablement différentes. Par exemple, la majeure ou une plus grande partie de ces ressources (200a, 210a, 230a) d'interconnexion à dualité de forme présente ce que l'on peut appeler une vitesse de signal normale, tandis qu'une plus petite partie (200b, 210b, 230b) peut présenter une vitesse notablement supérieure. La répartition secondaire des signaux (e.g. des signaux d'horloge ou de libération) peut également être améliorée, de même que les circuits entrée/sortie et les connexions en cascade entre des modules contigus ou voisins sur le dispositif.
États désignés : JP.
Office européen des brevets (OEB) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)