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1. (WO2000052487) VERIFICATION EFFICACE EN PARALLELE DE CI UTILISANT UN DISPOSITIF REPUTE BON POUR PRODUIRE LES REPONSES ATTENDUES
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2000/052487    N° de la demande internationale :    PCT/US2000/004864
Date de publication : 08.09.2000 Date de dépôt international : 24.02.2000
Demande présentée en vertu du Chapitre 2 :    30.09.2000    
CIB :
G01R 31/319 (2006.01), G01R 31/3193 (2006.01)
Déposants : FORMFACTOR, INC. [US/US]; 5666 La Ribera Street, Livermore, CA 94550 (US)
Inventeurs : ROY, Richard, S.; (US).
MILLER, Charles, A.; (US)
Mandataire : LARWOOD, David; Formfactor, Inc., 5666 La Ribera Street, Livermore, CA 94550 (US).
MERKADEAU, Stuart L.; Formfactor, Inc., 5666 La Ribera Street, Livermore, Ca California 94550 (US)
Données relatives à la priorité :
09/260,460 01.03.1999 US
Titre (EN) EFFICIENT PARALLEL TESTING OF INTEGRATED CIRCUIT DEVICES USING A KNOWN GOOD DEVICE TO GENERATE EXPECTED RESPONSES
(FR) VERIFICATION EFFICACE EN PARALLELE DE CI UTILISANT UN DISPOSITIF REPUTE BON POUR PRODUIRE LES REPONSES ATTENDUES
Abrégé : front page image
(EN)A system for testing integrated circuit devices is disclosed in which a tester communicates with a known good device through a channel. Tester-DUT interface circuitry is provided for monitoring the channel while the tester is writing data as part of a test sequence to locations in the known good device. In response, the interface circuitry writes the data to corresponding locations in each of a number of devices under test (DUTs). The interface circuitry monitors the channel while the tester is reading from the locations in the known good device (KGD), and in response performs a comparison between DUT data read from the corresponding locations in the DUTs and expected responses obtained from the KGD.
(FR)L'invention porte sur un système de vérification de CI dans lequel un vérificateur communique avec un dispositif réputé bon (KGD) via un canal. Un circuit d'interfaçage reliant le vérificateur aux CI à tester assure la surveillance du canal tandis que le vérificateur écrit des données faisant partie d'une séquence de vérification dans certains emplacements du KGD. En réponse le circuit d'interfaçage écrit les données dans les emplacements correspondants de chacun des CI en cours de vérification. Le circuit d'interfaçage surveille le canal tandis que le vérificateur lit dans les emplacements du KGD, et en réponse effectue une comparaison entre les données lues dans les emplacements correspondants de chacun des CI et les réponses attendues du KGD.
États désignés : AE, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, CA, CH, CN, CU, CZ, DE, DK, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MD, MG, MK, MN, MW, MX, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, UA, UG, UZ, VN, YU, ZA, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (GH, GM, KE, LS, MW, SD, SL, SZ, TZ, UG, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)