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1. (WO1997008703) MEMOIRE A ACCES SEQUENTIEL SAM A LARGEUR DE DONNEES EXTENSIBLE POUR UNE MEMOIRE VIVE A ACCES MULTIPLES
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/1997/008703    N° de la demande internationale :    PCT/US1996/014002
Date de publication : 06.03.1997 Date de dépôt international : 28.08.1996
Demande présentée en vertu du Chapitre 2 :    26.03.1997    
CIB :
G11C 7/10 (2006.01), H04L 12/56 (2006.01), H04Q 11/04 (2006.01)
Déposants : MICRON TECHNOLOGY, INC. [US/US]; 8000 South Federal Way, P.O. Box 6, Boise, ID 83707-0006 (US)
Inventeurs : HUSH, Glen, E.; (US).
THOMANN, Mark, D.; (US)
Mandataire : VIKSNINS, Ann, S.; Schwegman, Lundberg, Woessner & Kluth, P.O. Box 2938, Minneapolis, MN 55402 (US)
Données relatives à la priorité :
08/511,778 30.08.1995 US
Titre (EN) EXPANDABLE DATA WIDTH SAM FOR A MULTIPORT RAM
(FR) MEMOIRE A ACCES SEQUENTIEL SAM A LARGEUR DE DONNEES EXTENSIBLE POUR UNE MEMOIRE VIVE A ACCES MULTIPLES
Abrégé : front page image
(EN)A multiport memory is described which includes a random access memory (RAM) and serial access memories (SAMs). The multiport memory is well suited for storing asynchronous transfer mode (ATM) data cells. Control circuitry is provided to allow the multiport memory to be easily configured for operating at different input data rates. This is accomplished by configuring several of the SAMs to store a portion of an input ATM cell on an input clock cycle. The full ATM cell is stored in less clock cycles and can be transferred from the SAMs to the RAM in a single transfer cycle.
(FR)La présente invention concerne une mémoire à accès multiples. Elle comprend une mémoire vive et des mémoires à accès séquentiel (SAM). La mémoire à accès multiples convient bien pour le stockage de cellules de données à mode de transfert asynchrone (ATM). Des circuits de commande permettent de configurer facilement la mémoire à accès multiples pour qu'elle fonctionne avec différentes vitesses d'entrée des données. On y parvient en configurant plusieurs des mémoires à accès séquentiel de telle façon qu'elles stockent une partie d'une cellule ATM d'entrée sur un cycle d'horloge d'entrée. La totalité de la cellule ATM est stockée en moins de cycles d'horloge, et elle peut être transférée des SAM à la mémoire vive en un seul cycle de transfert.
États désignés : AL, AM, AT, AU, AZ, BB, BG, BR, BY, CA, CH, CN, CU, CZ, DE, DK, EE, ES, FI, GB, GE, HU, IL, IS, JP, KE, KG, KP, KR, KZ, LK, LR, LS, LT, LU, LV, MD, MG, MK, MN, MW, MX, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, TJ, TM, TR, TT, UA, UG, UZ, VN.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (KE, LS, MW, SD, SZ, UG)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, CH, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)