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1. (WO1997003401) COMPARAISON D'ADRESSES POUR MISE EN CONCORDANCE D'ADRESSES REDONDANTES NON PRECHARGEES
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/1997/003401    N° de la demande internationale :    PCT/US1996/010547
Date de publication : 30.01.1997 Date de dépôt international : 19.06.1996
Demande présentée en vertu du Chapitre 2 :    05.02.1997    
CIB :
G11C 29/00 (2006.01)
Déposants : MICRON TECHNOLOGY, INC. [US/US]; 8000 South Federal Way, P.O. Box 6, Boise, ID 83707-0006 (US)
Inventeurs : MORGAN, Donald, M.; (US)
Mandataire : VIKSNINS, Ann, S.; Schwegman, Lundberg, Woessner & Kluth, P.O. Box 2938, Minneapolis, MN 55402 (US)
Données relatives à la priorité :
08/501,212 11.07.1995 US
Titre (EN) ADDRESS COMPARING FOR NON-PRECHARGED REDUNDANCY ADDRESS MATCHING
(FR) COMPARAISON D'ADRESSES POUR MISE EN CONCORDANCE D'ADRESSES REDONDANTES NON PRECHARGEES
Abrégé : front page image
(EN)An integrated circuit includes primary circuit elements selectable by n address bits. A master storage device is programmable to indicate that at least one primary circuit element is being replaced. Redundant circuit elements each include a non-precharging matching circuit, which includes sub-match circuits. The sub-match circuits include two state storage devices corresponding to one of the possible binary values of at least one of the n address bits and activate a sub-match signal when the binary value of the at least one of the n address bits corresponds to one of the two state storage devices in a first state if the master storage device is programmed. A match circuit activates a match signal in response to all sub-match signals being active to disable a primary circuit element from being selected by a corresponding binary value of the n address bits and to enable the redundant circuit element to be selected by the corresponding binary value of the n address bits.
(FR)L'invention porte sur un circuit intégré comportant des éléments primaires de circuit pouvant être sélectionnés par n bits d'adresse. Un dispositif principal de stockage peut être programmé pour indiquer qu'au moins un des éléments primaires de circuit est remplacé. Des éléments de circuit redondants comportent chacun un circuit de remplacement non préchargé comportant des sous-circuits de remplacement. Les sous-circuits de remplacement, qui comportent des dispositifs de stockage à deux états correspondant à l'une des valeurs binaires d'au moins l'un des n bits d'adresse, activent un signal de remplacement partiel lorsque la valeur binaire d'au moins l'un des n bits d'adresse correspond à l'un des dispositifs de stockage à deux états se trouvant dans un premier état lorsque la mémoire principale est programmée. Un circuit de commande de remplacement active un signal de remplacement en réponse à l'activation de la totalité des signaux de remplacement partiel pour invalider la sélection d'un élément primaire de circuit par la valeur binaire correspondante des n bits d'adresse, et valider l'élément de circuit redondant à sélectionner par la valeur binaire correspondante des n bits d'adresse.
États désignés : AL, AM, AT, AU, AZ, BB, BG, BR, BY, CA, CH, CN, CZ, DE, DK, EE, ES, FI, GB, GE, HU, IL, IS, JP, KE, KG, KP, KR, KZ, LK, LR, LS, LT, LU, LV, MD, MG, MK, MN, MW, MX, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, TJ, TM, TR, TT, UA, UG, UZ, VN.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (KE, LS, MW, SD, SZ, UG)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, CH, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)