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1. (WO1997001901) REGENERATEUR D'HORLOGE ET DE DONNEES POUR SIGNAUX GIGABINAIRES
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/1997/001901    N° de la demande internationale :    PCT/DE1996/001075
Date de publication : 16.01.1997 Date de dépôt international : 18.06.1996
Demande présentée en vertu du Chapitre 2 :    22.11.1996    
CIB :
H03L 7/08 (2006.01), H04J 3/04 (2006.01), H04L 7/033 (2006.01)
Déposants : SIEMENS AKTIENGESELLSCHAFT [DE/DE]; Wittelsbacherplatz 2, D-80333 München (DE)
Inventeurs : ZIRWAS, Wolfgang; (DE)
Données relatives à la priorité :
195 23 185.6 26.06.1995 DE
Titre (DE) TAKT- UND DATENREGENERATOR FÜR GIGABITSIGNALE
(EN) CLOCK AND DATA REGENERATOR FOR GIGABIT SIGNALS
(FR) REGENERATEUR D'HORLOGE ET DE DONNEES POUR SIGNAUX GIGABINAIRES
Abrégé : front page image
(DE)Bei der Übertragung digitaler Signale mit Gigabitraten sind die kritischen Weglängen so klein, daß bei üblichen Taktrückgewinnungsschaltungen mit Phasenschwankungen zwischen Takt- und Datenphase in der Größenordnung der sehr kurzen Bitdauer zu rechnen ist. Es wird deshalb ein Takt- und Datenregenerator vorgeschlagen, der nur drei eingangsseitig parallel geschaltete D-Flip-Flops (DF1, DF2, DF3) und ein Laufzeitglied (T/2) enthält, die mit den hohen Bitraten des Eingangssignals beaufschlagt sind, während durch die gleichzeitige Ausbildung als 2:1-Demultiplexer alle anderen Bauteile mit niedrigeren Takt- bzw. Datenraten arbeiten. Für einen erweiterten Fangbereich enthalten Weiterbildungen eine Frequenzregelschleife mit nachgeschaltetem Fensterdiskriminator oder Frequenzdetektor.
(EN)During the transmission of digital signals at gigabit rates the critical distances are so small that in usual clock retrieval circuits phase oscillations between clock and data phases are to be expected of the order of the very short bit length. A clock and data regenerator is therefore disclosed with only three D-flip-flops (DF1, DF2, DF3) and one delay unit (T/2) interconnected in parallel at the input side that receive the high bit rates of the input signal, whereas all other components are designed as a 2:1 demultiplexer and work at lower clock and data rates. To widen the capture range, developments of the invention include a frequency regulating loop connected to a downstream window discriminator or frequency detector.
(FR)Lors de la transmission à des débits gigabinaires de signaux numériques, les distances critiques sont si petites que dans les circuits usuels régénérateurs d'horloge il faut s'attendre à des oscillations de phase entre la phase d'horloge et la phase de données de l'ordre de la très courte durée des bits. L'invention concerne par conséquent un régénérateur d'horloge et de données qui contient côté entrée uniquement trois bascules D (DF1, DF2, DF3) et une bascule à retard (T/2) interconnectées en parallèle qui reçoivent les débits binaires élevés du signal d'entrée, alors que tous les autres composants, conçus comme un démultiplexeur 2:1, fonctionnent à un faible débit d'informations et à une basse fréquence d'horloge. Pour élargir la plage de synchronisation, des développements de l'invention comprennent une boucle de régulation de fréquence connectée en amont d'un discriminateur de fenêtre ou d'un détecteur de fréquences.
États désignés : AU, BR, CN, NO.
Office européen des brevets (OEB) (AT, BE, CH, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE).
Langue de publication : allemand (DE)
Langue de dépôt : allemand (DE)