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1. (WO1994006076) DIVISEUR DE MANTISSE A HAUTE PERFORMANCE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/1994/006076    N° de la demande internationale :    PCT/US1993/007192
Date de publication : 17.03.1994 Date de dépôt international : 26.07.1993
Demande présentée en vertu du Chapitre 2 :    22.03.1994    
CIB :
G06F 7/52 (2006.01)
Déposants : CRAY RESEARCH, INC. [US/US]; 655-A Lone Oak Drive, Eagan, MN 55121 (US)
Inventeurs : SMITH, James, E.; (US)
Mandataire : RAASCH, Kevin, W.; Schwegman, Lundberg & Woessner, 3500 IDS Center, 80 South Eighth Street, Minneapolis, MN 55402 (US)
Données relatives à la priorité :
07/938,715 01.09.1992 US
Titre (EN) HIGH PERFORMANCE MANTISSA DIVIDER
(FR) DIVISEUR DE MANTISSE A HAUTE PERFORMANCE
Abrégé : front page image
(EN)A high performance floating point mantissa divider employs SRT division, a Radix-4 redundant digit set and the principles of carry-save addition. At each step in the division, the upper few most significant bits of the partial remainder and the divisor are inspected via a look-up table to select the appropriate quotient digits. The quotient digits are represented in a Radix-4 redundant digit set, and the look-up table is generated using SRT division principles. The selected quotient digit is used to control a multiplexor which selects the selected multiple of the divisor. This value is substracted from the partial remainder via a carry-save adder to form the new partial remainder. As the quotient digits are generated, they are placed in two shift registers, one for the sum digits and one for carry digits. When the division is complete, the shift registers are added to give the final quotient mantissa. A combination of a carry save adder and carry lookahead adder reduce the practical implementation to only 8 logic levels.
(FR)Un diviseur de mantisse à virgule flottante et à haute performance utilise la division SRT, un ensemble de chiffres redondants base-4 et les principes d'addition à sauvegarde de report. A chaque étape de la division, les quelques bits supérieurs de poids fort du reste partiel ainsi que le diviseur sont examinés par l'intermédiaire d'une table à consulter afin de choisir les chiffres de quotient appropriés. Les chiffres de quotient sont représentés dans un ensemble de chiffres redondants base-4, et la table à consultr est générée à l'aide de principes de division SRT. Le chiffre choisi du quotient est utilisé pour commander un multiplexeur qui sélectionne le multiple choisi du diviseur. Cette valeur est soustraite du reste partiel au moyen d'un additionneur à sauvegarde de report pour former le nouveau reste partiel. Au fur et à mesure que les chiffres de quotient sont générés, ils sont placés dans deux registres de décalage, un pour les chiffres de la somme et un pour les chiffres de report. Lorsque la division est complétée, les registres de décalage sont additionnés afin de produire la mantisse du quotient final. Une combinaison d'un additionneur à sauvegarde de report et d'un additionneur à anticipation de report permet de réduire l'application pratique à 8 niveaux logiques seulement.
États désignés : CA, JP.
Office européen des brevets (OEB) (AT, BE, CH, DE, DK, ES, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)