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1. (WO1994001841) PROCEDE ET DISPOSITIF D'ECONOMIE D'ENERGIE POUR UN RECEPTEUR DE COMMUNICATION DE DONNEES
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/1994/001841    N° de la demande internationale :    PCT/US1993/005452
Date de publication : 20.01.1994 Date de dépôt international : 09.06.1993
CIB :
H04W 52/02 (2009.01), H04W 88/02 (2009.01)
Déposants : MOTOROLA, INC. [US/US]; 1303 East Algonquin Road, Schaumburg, IL 60196 (US)
Inventeurs : PETREYE, David, Royce; (US)
Mandataire : KOCH, William, E.; Motorola, Inc., Intellectual Property Dept./MJD, 1500 N.W. 22nd Avenue, Boynton Beach, FL 33426-8292 (US)
Données relatives à la priorité :
07/908,271 02.07.1992 US
Titre (EN) POWER CONSERVATION METHOD AND APPARATUS FOR A DATA COMMUNICATION RECEIVER
(FR) PROCEDE ET DISPOSITIF D'ECONOMIE D'ENERGIE POUR UN RECEPTEUR DE COMMUNICATION DE DONNEES
Abrégé : front page image
(EN)A data communication receiver (106) comprises a receiver (804) for receiving transmitted coded message signals comprising at least one block of up to N addresses of M bits interleaved to degree N, where M and N are integer numbers. A battery saver circuit (848) supplies power to the receiver (804). A signal recovery circuit (808, 810, 812, 814, 816), coupled to the receiver (804), recovers the received coded message signals to generate up to M N-bit data streams. An address correlator (830), coupled to the signal recovery circuit (808, 810, 812, 814, 816), correlates at least a portion of the M N-bit data streams with a corresponding portion of a predetermined M-bit code word to derive up to N error counts corresponding to the up to N addresses. The battery saving circuit (848) is responsive to the address correlator (830) and suspends the supply of power to the receiver (804) when each of the N error counts exceeds a predetermined error count.
(FR)Un récepteur de communication de données (106) comprend un récepteur (804) qui reçoit des signaux de messages codés transmis comprenant au moins un bloc comportant jusqu'à N adresses de M bits entrelacés au degré N, M et N étant des nombres entiers. Un circuit économiseur de batterie (848) alimente le récepteur (804) en courant. Un circuit de récupération de signaux (808, 810, 812, 814, 816), couplé au récepteur (804), récupère les signaux de messages codés reçus pour produire jusqu'à M flux de données de N bits. Un corrélateur d'adresses (830) couplé au circuit de récupération de signaux (808, 810, 812, 814, 816), établit une corrélation entre au moins une partie des M flux de données de N bits et une partie correspondante d'un mot de code de M bits prédéterminé, afin de dériver jusqu'à N nombres d'erreurs correspondant aux N adresses. Le circuit économiseur de batterie (848) réagit aux signaux du corrélateur d'adresses (830) et interrompt l'alimentation en courant du récepteur (804) lorsque chacun des N nombres d'erreurs dépasse une valeur prédéterminée.
États désignés : CA, JP, KR.
Office européen des brevets (OEB) (AT, BE, CH, DE, DK, ES, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)