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1. (WO1986003913) SYSTEME RADIO A BUS SERIE, MODELE PAR REGISTRES
Dernières données bibliographiques dont dispose le Bureau international

N° de publication : WO/1986/003913 N° de la demande internationale : PCT/US1985/002170
Date de publication : 03.07.1986 Date de dépôt international : 01.11.1985
CIB :
H04B 1/40 (2006.01)
H ÉLECTRICITÉ
04
TECHNIQUE DE LA COMMUNICATION ÉLECTRIQUE
B
TRANSMISSION
1
Détails des systèmes de transmission, non couverts par l'un des groupes H04B3/-H04B13/129; Détails des systèmes de transmission non caractérisés par le milieu utilisé pour la transmission
38
Emetteurs récepteurs, c. à d. dispositifs dans lesquels l'émetteur et le récepteur forment un ensemble structural et dans lesquels au moins une partie est utilisée pour des fonctions d'émission et de réception
40
Circuits
Déposants :
MOTOROLA, INC. [US/US]; 1303 East Algonquin Road Schaumburg, IL 60196, US
Inventeurs :
BURKE, Timothy, Mark; US
SMITH, Paul, Fielding; US
SCHORMAN, Eric, Reed; US
Mandataire :
SOUTHARD, Donald, B. @; Motorola, Inc., Patent Department 1303 East Algonquin Road Schaumburg, IL 60196, US
Données relatives à la priorité :
684,63121.12.1984US
Titre (EN) INTERNALLY REGISTER-MODELLED, SERIALLY-BUSSED RADIO SYSTEM
(FR) SYSTEME RADIO A BUS SERIE, MODELE PAR REGISTRES
Abrégé :
(EN) Register-modelled radio system comprising a plurality of register-modelled processors having the addressable registers (240) for modelling the virtual state of the processor; a serial bus (230) interconnecting the register-modelled processors for communicating between the addressable registers; and a communications protocol (310) for passing said information to or from said addressable registers (240), whereby the virtual state of said radio portion may be determined or altered by, respectively, communicating information from or to said addressable register means (240). The communications protocol (310) further comprises information packet having an address, an operation code, optional data, and an error detection device, such as a cyclical redundancy check packet. The operation code is chosen from the group of primitive operations codes reset, read, write, bit set, bit clear; ackowledge, and negative acknowledge.
(FR) Système radio modelé par registres comprenant une pluralité de processeurs modelés par registres possédant des registres permettant l'adressage (240) pour modeler l'état virtuel du processeur; un bus série (230) reliant entre eux les processeurs modelés par registres pour communiquer entre les registres permettant l'adressage, et un protocole de communications (310) pour transmettre lesdites informations vers lesdits registres permettant l'adressage (240), ou à partir d'eux, où l'état virtuel de ladite partie radio peut être déterminé ou modifié respectivement en communiquant des informations provenant dudit moyen de registre permettant l'adressage (240) ou allant vers lui. Le protocole de communications (310) comprend de plus un paquet d'informations possédant une adresse, un code d'opération, des données facultatives et un système de detection des erreurs, comme un paquet de contrôle de redondances cycliques. Le code d'opération est choisi dans un groupe de codes d'opération primitifs: remettre à zéro, lire, écrire, introduire des bits, supprimer des bits; accuser réception et accuser réception négativement.
États désignés : AU, JP, KR
Office européen des brevets (OEB) (AT, BE, CH, DE, FR, GB, IT, NL, SE)
Langue de publication : Anglais (EN)
Langue de dépôt : Anglais (EN)
Également publié sous:
EP0207948CA1251517KR1019880700555AU1985050138