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1. (WO1980002760) SYSTEME DE DECODAGE DE SYMBOLE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/1980/002760    N° de la demande internationale :    PCT/US1980/000666
Date de publication : 11.12.1980 Date de dépôt international : 29.05.1980
CIB :
G06K 7/016 (2006.01)
Déposants :
Inventeurs :
Données relatives à la priorité :
43933 30.05.1979 US
Titre (EN) SYMBOL DECODING SYSTEM
(FR) SYSTEME DE DECODAGE DE SYMBOLE
Abrégé : front page image
(EN)A symbol decoding system incorporated in a NMOS/LSI chip (24) generates asynchronously binary data in response to the scanning of bars and spaces of the symbol. The binary data may represent each bar or space as a numerical character, a margin or a center band of the symbol. The binary data also includes data identifying respective bars and spaces (MARK) and if the character generated is valid or invalid (EQUAL). The validity signal is generated by comparing a count derived from scanning four consecutive intervals with the count from scanning the previous four consecutive intervals. Logic circuits (52, 56, 60) generate a time delay period allowing the binary data to be generated asynchronously during the delay period. At the end of the delay period the binary data is outputted to a utilizing device (28) for selecting the valid data from the data outputted by the decoding system.
(FR)Un systeme de decodage de symboles incorpore dans une microplaquette NMOS/LSI (24) produit des donnees binaires de maniere asynchrone en reponse a l"analyse des barres et des espaces du symbole. Les donnees binaires representent chaque barre ou espace sous forme d"un caractere numerique, une bande marginale ou une bande centrale du symbole. Les donnees binaires comprennent aussi des donnees identifiant les barres et espaces respectifs (MARQUE) et si le caractere produit est valide ou non valide (EGAL). Le signal de validite est produit en comparant un comptage derive de l"analyse de quatre intervalles consecutifs au comptage resultant de l"analyse de quatre intervalles consecutifs precedents. Des circuits logiques (52, 56, 60) generent une periode de temporisation permettant aux donnees binaires d"etre produites de maniere asynchrone pendant la temporisation. A la fin de la temporisation, les donnees binaires sont sorties et envoyees a un dispositif d"utilisation (28) qui selectionne les donnees valides des donnees sorties par le systeme de decodage.
États désignés :
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)