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1. WO1995006280 - APPAREIL ET PROCEDE PERMETTANT D'ACCELERER LE TRANSFERT DE DONNEES

Numéro de publication WO/1995/006280
Date de publication 02.03.1995
N° de la demande internationale PCT/US1994/009604
Date du dépôt international 26.08.1994
Demande présentée en vertu du Chapitre 2 22.03.1995
CIB
G06F 9/312 2006.1
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
9Dispositions pour la commande par programme, p.ex. unités de commande
06utilisant des programmes stockés, c. à d. utilisant un moyen de stockage interne à l'équipement de traitement de données pour recevoir ou conserver les programmes
30Dispositions pour exécuter des instructions machines, p.ex. décodage d'instructions
312Commande des opérations de chargement, d'enregistrement ou d'effacement
CPC
G06F 9/30043
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
9Arrangements for program control, e.g. control units
06using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
30Arrangements for executing machine instructions, e.g. instruction decode
30003Arrangements for executing specific machine instructions
3004to perform operations on memory
30043LOAD or STORE instructions; Clear instruction
Déposants
  • ELECTRONIC ARTS, INC. [US]/[US]
Inventeurs
  • FOWLER, Terry
  • McGRATH, Kevin
  • GOODE, Terry, Lee
  • SCHNECKLOTH, Mark
Mandataires
  • TRUONG, Phong, K.
Données relatives à la priorité
08/112,11326.08.1993US
Langue de publication anglais (EN)
Langue de dépôt anglais (EN)
États désignés
Titre
(EN) DATA TRANSFER ACCELERATING APPARATUS AND METHOD
(FR) APPAREIL ET PROCEDE PERMETTANT D'ACCELERER LE TRANSFERT DE DONNEES
Abrégé
(EN)
In a computing system, data is transferred from a data source (18) to a memory (20) by generating and sending an optimized instruction sequence to a central processing unit (CPU 12). The CPU (12) executes the instruction sequence to carry out the data transfer in an optimal manner. An apparatus for carrying out the above method comprises a determiner (50), an instruction generator (52), and a coupling circuit (54). The determiner (50), in response to a determination that data transfer is desired, generates a run control signal. The instruction generator (52) generates an optimized instruction sequence using data and address information received from the data source (18), and provides this instruction sequence on its output. The coupling circuit (54), in response to the run control signal, relays the optimized instruction sequence from the instruction generator (52) to the CPU (12) to allow the CPU (12) to execute the instruction set to transfer data from the data source (18) to the memory (20).
(FR)
Dans un système informatique, le transfert de données s'effectue depuis une source de données (18) vers une mémoire (20) par génération et envoi d'une séquence d'instructions optimisée vers une unité centrale (UC 12). L'UC (12) exécute la séquence d'instructions de façon à effectuer le transfert de données de manière optimale. Un appareil permettant de mener à bien ce procédé comprend un déterminateur (50), un générateur d'instructions (52) ainsi qu'un circuit de couplage (54). Le déterminateur (50), en réponse à une demande de transfert de données, produit un signal d'exécution. Le générateur d'instructions (52) génère une séquence d'instructions optimisée à l'aide des informations de données et d'adresses transmises par la source de données (18) et dirige cette séquence d'instructions vers sa sortie. Le circuit de couplage (54), en réponse au signal d'exécution, effectue le relais pour transmettre la séquence d'instructions optimisée entre le générateur d'instructions (52) et l'UC (12), afin de permettre à celle-ci d'exécuter l'ensemble d'instructions (52) en vue d'effectuer le transfert de données depuis la source de données (18) vers la mémoire (20).
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