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1. (WO2019046716) POINTER-SIZE CONTROLLED INSTRUCTION PROCESSING
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Nº de publicación: WO/2019/046716 Nº de la solicitud internacional: PCT/US2018/049089
Fecha de publicación: 07.03.2019 Fecha de presentación de la solicitud internacional: 31.08.2018
CIP:
G06F 9/30 (2006.01)
G FISICA
06
COMPUTO; CALCULO; CONTEO
F
TRATAMIENTO DE DATOS DIGITALES ELECTRICOS
9
Disposiciones para el control por programa, p. ej. unidad de control
06
que utilizan un programa almacenado, es decir que utilizan una unidad de almacenamiento interna del equipo de tratamiento de datos para recibir y conservar el programa
30
Disposiciones para ejecutar instrucciones máquina, p. ej. decodificación de instrucciones
Solicitantes:
MIPS TECH, LLC [US/US]; 3201 Scott Blvd. Santa Clara, CA 95054, US
Personas inventoras:
ROBINSON, James, Hippisley; US
TAYLOR, Morgyn; US
Mandataria/o:
ADAMS, R., Dean; US
Datos de prioridad:
62/552,84131.08.2017US
Título (EN) POINTER-SIZE CONTROLLED INSTRUCTION PROCESSING
(FR) TRAITEMENT D'INSTRUCTIONS COMMANDÉ PAR TAILLE DE POINTEUR
Resumen:
(EN) Instruction set architectures (ISAs) and apparatus and methods related thereto comprise a variable length instruction set that includes one or more pointer-size controlled memory access instructions of a smaller length (e.g. 16 bits) wherein the size of the data accessed by such an instruction is dynamically determined based on the size of the pointer. Specifically, when a pointer-size controlled memory access instruction is received at a decode unit, the decode unit outputs one or more control signals to cause an execution unit to perform a memory access of a first size (e.g. 32 bits) when the pointer size is the first size (e.g. 32 bits), and output one or more control signals to cause the execution unit to perform a memory access of a second size (e.g. 64 bits) when the pointer size is the second size (e.g. 64 bits).
(FR) Des architectures d'ensembles d'instructions (ISA), ainsi qu’un appareil et des procédés associés à celles-ci, comprennent un ensemble d'instructions de longueur variable comportant une ou plusieurs instructions d'accès mémoire commandées par taille de pointeur d'une longueur inférieure (par exemple, 16 bits), la taille des données accessibles par une telle instruction étant déterminée de manière dynamique d’après la taille du pointeur. En particulier, lorsqu'une instruction d'accès mémoire commandée par taille de pointeur est reçue dans une unité de décodage, l'unité de décodage génère un ou plusieurs signaux de commande pour amener une unité d'exécution à effectuer un accès mémoire d'une première taille (par exemple, 32 bits) lorsque la taille du pointeur est la première taille (par exemple, 32 bits) et génère un ou plusieurs signaux de commande pour amener l'unité d'exécution à effectuer un accès mémoire d'une seconde taille (par exemple, 64 bits) lorsque la taille du pointeur est la seconde taille (par exemple, 64 bits).
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Estados designados: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
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Organización Africana de la Propiedad Intelectual (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Idioma de publicación: Inglés (EN)
Idioma de la solicitud: Inglés (EN)