Parte del contenido de esta aplicación no está disponible en este momento.
Si esta situación persiste, contáctenos aComentarios y contacto
1. (WO2017139410) INTEGRATED DEVICE COMPRISING A CAPACITOR THAT INCLUDES MULTIPLE PINS AND AT LEAST ONE PIN THAT TRAVERSES A PLATE OF THE CAPACITOR
Datos bibliográficos más recientes de la Oficina Internacional    Formular observación

Nº de publicación: WO/2017/139410 Nº de la solicitud internacional: PCT/US2017/017059
Fecha de publicación: 17.08.2017 Fecha de presentación de la solicitud internacional: 08.02.2017
Se presentó la solicitud en virtud del Capítulo II: 05.12.2017
CIP:
H01L 23/64 (2006.01) ,H01L 23/498 (2006.01) ,H01L 23/538 (2006.01) ,H01L 21/60 (2006.01) ,H01L 49/02 (2006.01)
H ELECTRICIDAD
01
ELEMENTOS ELECTRICOS BASICOS
L
DISPOSITIVOS SEMICONDUCTORES; DISPOSITIVOS ELECTRICOS DE ESTADO SOLIDO NO PREVISTOS EN OTRO LUGAR
23
Detalles de dispositivos semiconductores o de otros dispositivos de estado sólido
58
Disposiciones eléctricas estructurales no previstas en otra parte para dispositivos semiconductores
64
Disposiciones relativas a la impedancia
H ELECTRICIDAD
01
ELEMENTOS ELECTRICOS BASICOS
L
DISPOSITIVOS SEMICONDUCTORES; DISPOSITIVOS ELECTRICOS DE ESTADO SOLIDO NO PREVISTOS EN OTRO LUGAR
23
Detalles de dispositivos semiconductores o de otros dispositivos de estado sólido
48
Disposiciones para conducir la corriente eléctrica hacia o desde el cuerpo de estado sólido durante su funcionamiento, p. ej. hilos de conexión o bornes
488
formadas por estructuras soldadas
498
Conexiones eléctricas sobre sustratos aislantes
H ELECTRICIDAD
01
ELEMENTOS ELECTRICOS BASICOS
L
DISPOSITIVOS SEMICONDUCTORES; DISPOSITIVOS ELECTRICOS DE ESTADO SOLIDO NO PREVISTOS EN OTRO LUGAR
23
Detalles de dispositivos semiconductores o de otros dispositivos de estado sólido
52
Disposiciones para conducir la corriente eléctrica en el interior del dispositivo durante su funcionamiento, de un componente a otro
538
estando la estructura de interconexión entre una pluralidad de chips semiconductores situada en el interior o encima de sustratos aislantes
H ELECTRICIDAD
01
ELEMENTOS ELECTRICOS BASICOS
L
DISPOSITIVOS SEMICONDUCTORES; DISPOSITIVOS ELECTRICOS DE ESTADO SOLIDO NO PREVISTOS EN OTRO LUGAR
21
Procedimientos o aparatos especialmente adaptados para la fabricación o el tratamiento de dispositivos semiconductores o de dispositivos de estado sólido, o bien de sus partes constitutivas
02
Fabricación o tratamiento de dispositivos semiconductores o de sus partes constitutivas
04
los dispositivos presentan al menos una barrera de potencial o una barrera de superficie, p. ej. una unión PN, una región de empobrecimiento, o una región de concentración de portadores de cargas
50
Ensamblaje de dispositivos semiconductores utilizando procesos o aparatos no cubiertos por un único grupo deH01L21/06-H01L21/326215
60
Fijación de hilos de conexión o de otras piezas conductoras, para conducir la corriente hacia o desde el dispositivo durante su funcionamiento
H ELECTRICIDAD
01
ELEMENTOS ELECTRICOS BASICOS
L
DISPOSITIVOS SEMICONDUCTORES; DISPOSITIVOS ELECTRICOS DE ESTADO SOLIDO NO PREVISTOS EN OTRO LUGAR
49
Dispositivos de estado sólido no cubiertos por los gruposH01L27/-H01L47/164; Procesos o aparatos especialmente adaptados a la fabricación o al tratamiento de estos dispositivos o de sus partes constitutivas
02
Dispositivos de película delgada o de película gruesa
Solicitantes:
QUALCOMM INCORPORATED [US/US]; ATTN: International IP Administration 5775 Morehouse Drive San Diego, California 92121-1714, US
Personas inventoras:
GU, Shiqun; US
PANDEY, Shree Krishna; US
RADOJCIC, Ratibor; US
Mandataria/o:
LOZA, Julio; US
Datos de prioridad:
15/041,85311.02.2016US
Título (EN) INTEGRATED DEVICE COMPRISING A CAPACITOR THAT INCLUDES MULTIPLE PINS AND AT LEAST ONE PIN THAT TRAVERSES A PLATE OF THE CAPACITOR
(FR) DISPOSITIF INTÉGRÉ COMPRENANT UN CONDENSATEUR COMPORTANT DE MULTIPLES BROCHES ET AU MOINS UNE BROCHE TRAVERSANT UNE PLAQUE DU CONDENSATEUR
Resumen:
(EN) Some features pertain to an integrated device that includes a die and a first redistribution portion coupled to the die. The first redistribution portion includes at least one dielectric layer and a capacitor. The capacitor includes a first plate, a second plate, and an insulation layer located between the first plate and the second plate. The first redistribution portion further includes several first pins coupled to the first plate of the capacitor. The first redistribution portion further includes several second pins coupled to the second plate of the capacitor. In some implementations, the capacitor includes the first pins and/or the second pins. In some implementations, at least one pin from the several first pins traverses through the second plate to couple to the first plate of the capacitor. In some implementations, the second plate comprises a fin design.
(FR) Certaines caractéristiques de l'invention se rapportent à un dispositif intégré qui comprend une puce et une première partie de redistribution couplée à la puce. La première partie de redistribution comprend au moins une couche diélectrique et un condensateur. Le condensateur comprend une première plaque, une seconde plaque, et une couche isolante située entre la première plaque et la seconde plaque. La première partie de redistribution comprend en outre plusieurs premières broches couplées à la première plaque du condensateur. La première partie de redistribution comprend en outre plusieurs secondes broches couplées à la seconde plaque du condensateur. Dans certains modes de réalisation, le condensateur comprend les premières broches et/ou les secondes broches. Dans certains modes de réalisation, au moins une broche parmi les multiples premières broches traverse la seconde plaque pour être couplée à la première plaque du condensateur. Dans certains modes de réalisation, la seconde plaque comprend une conception à ailettes.
front page image
Estados designados: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
African Regional Intellectual Property Organization (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Oficina Eurasiática de Patentes (AM, AZ, BY, KG, KZ, RU, TJ, TM)
Oficina Europea de Patentes (OEP) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
Organización Africana de la Propiedad Intelectual (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Idioma de publicación: Inglés (EN)
Idioma de la solicitud: Inglés (EN)