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1. WO2022008796 - QUBIT LEAKAGE ERROR REDUCTION

Publication Number WO/2022/008796
Publication Date 13.01.2022
International Application No. PCT/FI2021/050520
International Filing Date 05.07.2021
IPC
G06N 10/00 2022.1
GPHYSICS
06COMPUTING; CALCULATING OR COUNTING
NCOMPUTER SYSTEMS BASED ON SPECIFIC COMPUTATIONAL MODELS
10Quantum computers, i.e. computer systems based on quantum-mechanical phenomena
B82Y 10/00 2011.1
BPERFORMING OPERATIONS; TRANSPORTING
82NANOTECHNOLOGY
YSPECIFIC USES OR APPLICATIONS OF NANOSTRUCTURES; MEASUREMENT OR ANALYSIS OF NANOSTRUCTURES; MANUFACTURE  OR TREATMENT OF NANOSTRUCTURES
10Nanotechnology for information processing, storage or transmission, e.g. quantum computing or single electron logic
H03K 17/92 2006.1
HELECTRICITY
03BASIC ELECTRONIC CIRCUITRY
KPULSE TECHNIQUE
17Electronic switching or gating, i.e. not by contact-making and -breaking
51characterised by the use of specified components
92by the use, as active elements, of superconductive devices
H03K 19/195 2006.1
HELECTRICITY
03BASIC ELECTRONIC CIRCUITRY
KPULSE TECHNIQUE
19Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
02using specified components
195using superconductive devices
Applicants
  • IQM FINLAND OY [FI]/[FI]
Inventors
  • AHONEN, Olli
  • HEINSOO, Johannes
  • MÖTTÖNEN, Mikko
  • RÖNKKÖ, Jami
  • SALO, Jaakko
  • TUORILA, Jani
Agents
  • PAPULA OY
Priority Data
20184473.507.07.2020EP
Publication Language English (en)
Filing Language English (EN)
Designated States
Title
(EN) QUBIT LEAKAGE ERROR REDUCTION
(FR) RÉDUCTION D'ERREURS DE FUITE DE BITS QUANTIQUES
Abstract
(EN) It is an objective to provide an arrangement for reducing qubit leakage errors in quantum computing system. According to an embodiment, an arrangement (100) for reducing qubit leakage errors comprises a first qubit (101) and a second qubit (102) selectively couplable to each other. The arrangement (100) may further comprise a first energy dissipation structure (103) selectively couplable to the first qubit (101), wherein the first energy dissipation structure (103) is configured to dissipate energy transferred to the first energy dissipation structure (103). The arrangement (100) may further comprise a control unit (104) configured to: perform a first quantum operation to transfer at least one property of a quantum state from the first qubit (101) to the second qubit (102); couple the first qubit (101) to the first energy dissipation structure (103) for a time interval; and perform a second quantum operation to transfer the at least one property of the quantum state from the second qubit (102) to the first qubit (101) after the time interval.
(FR) L'objet de la présente invention est de fournir un montage permettant de réduire les erreurs de fuite de bits quantiques dans un système informatique quantique. Selon un mode de réalisation, un montage (100) permettant de réduire les erreurs de fuite de bits quantiques comprend un premier bit quantique (101) et un second bit quantique (102) pouvant être couplés sélectivement l'un à l'autre. Le montage (100) peut en outre comprendre une première structure de dissipation d'énergie (103) pouvant être couplée sélectivement au premier bit quantique (101), la première structure de dissipation d'énergie (103) étant conçue pour dissiper l'énergie transférée à la première structure de dissipation d'énergie (103). Le montage (100) peut en outre comprendre une unité de commande (104) conçue pour : effectuer une première opération quantique pour transférer au moins une propriété d'un état quantique du premier bit quantique (101) au second bit quantique (102); coupler le premier bit quantique (101) à la première structure de dissipation d'énergie (103) pendant un intervalle de temps; et effectuer une seconde opération quantique pour transférer ladite propriété de l'état quantique du second bit quantique (102) au premier bit quantique (101) après l'intervalle de temps.
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