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1. WO2020058800 - ENCODER-DECODER MEMORY-AUGMENTED NEURAL NETWORK ARCHITECTURES

Publication Number WO/2020/058800
Publication Date 26.03.2020
International Application No. PCT/IB2019/057562
International Filing Date 09.09.2019
IPC
G06N 3/04 2006.01
GPHYSICS
06COMPUTING; CALCULATING OR COUNTING
NCOMPUTER SYSTEMS BASED ON SPECIFIC COMPUTATIONAL MODELS
3Computer systems based on biological models
02using neural network models
04Architecture, e.g. interconnection topology
Applicants
  • INTERNATIONAL BUSINESS MACHINES CORPORATION [US/US]; New Orchard Road Armonk, New York 10504, US
  • IBM UNITED KINGDOM LIMITED [GB/GB]; PO Box 41, North Harbour Portsmouth Hampshire PO6 3AU, GB (MG)
  • IBM (CHINA) INVESTMENT COMPANY LIMITED [CN/CN]; 25/F, Pangu Plaza No.27, Central North 4th Ring Road, Chaoyang District, Beijing 100101, CN (MG)
Inventors
  • THATHACHAR, Jayram; US
  • KORNUTA, Tomasz; US
  • OZCAN, Ahmet, Serkan; US
Agents
  • PYECROFT, Justine; GB
Priority Data
16/135,99019.09.2018US
Publication Language English (EN)
Filing Language English (EN)
Designated States
Title
(EN) ENCODER-DECODER MEMORY-AUGMENTED NEURAL NETWORK ARCHITECTURES
(FR) ARCHITECTURES DE RÉSEAU NEURONAL À MÉMOIRE AUGMENTÉE PAR CODEUR-DÉCODEUR
Abstract
(EN)
Memory-augmented neural networks are provided. An encoder artificial neural network is adapted to receive an input and provide an encoded output based on the input. A plurality of decoder artificial neural networks is provided, each adapted to receive an encoded input and provide an output based on the encoded input. A memory is operatively coupled to the encoder artificial neural network and to the plurality of decoder artificial neural networks. The memory is adapted to store the encoded output of the encoder artificial neural network and provide the encoded input to the plurality of decoder artificial neural networks.
(FR)
La présente invention concerne des réseaux neuronaux à mémoire augmentée. Un réseau neuronal artificiel de codeur est configuré pour recevoir une entrée et fournir une sortie codée sur la base de l'entrée. Une pluralité de réseaux neuronaux artificiels de décodeur sont prévus, chacun étant configuré pour recevoir une entrée codée et fournir une sortie sur la base de l'entrée codée. Une mémoire est fonctionnellement couplée au réseau neuronal artificiel de codeur et à la pluralité de réseaux neuronaux artificiels de décodeur. La mémoire est configurée pour mémoriser la sortie codée du réseau neuronal artificiel de codeur et pour fournir l'entrée codée à la pluralité de réseaux neuronaux artificiels de décodeur.
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