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1. (WO2019065302) DATA TRANSMISSION DEVICE FOR IN-VEHICLE MULTI-CORE CONTROL AND ELECTRONIC CONTROL DEVICE
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Pub. No.: WO/2019/065302 International Application No.: PCT/JP2018/034137
Publication Date: 04.04.2019 International Filing Date: 14.09.2018
IPC:
G06F 15/167 (2006.01) ,F02D 45/00 (2006.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
15
Digital computers in general; Data processing equipment in general
16
Combinations of two or more digital computers each having at least an arithmetic unit, a programme unit and a register, e.g. for a simultaneous processing of several programmes
163
Interprocessor communication
167
using a common memory, e.g. mailbox
F MECHANICAL ENGINEERING; LIGHTING; HEATING; WEAPONS; BLASTING
02
COMBUSTION ENGINES; HOT-GAS OR COMBUSTION-PRODUCT ENGINE PLANTS
D
CONTROLLING COMBUSTION ENGINES
45
Electrical control not provided for in groups F02D41/-F02D43/98
Applicants:
日立オートモティブシステムズ株式会社 HITACHI AUTOMOTIVE SYSTEMS, LTD. [JP/JP]; 茨城県ひたちなか市高場2520番地 2520, Takaba, Hitachinaka-shi, Ibaraki 3128503, JP
Inventors:
三宅 淳司 MIYAKE Junji; JP
Agent:
戸田 裕二 TODA Yuji; JP
Priority Data:
2017-18597727.09.2017JP
Title (EN) DATA TRANSMISSION DEVICE FOR IN-VEHICLE MULTI-CORE CONTROL AND ELECTRONIC CONTROL DEVICE
(FR) DISPOSITIF DE TRANSMISSION DE DONNÉES POUR COMMANDE MULTICŒUR DANS UN VÉHICULE ET DISPOSITIF DE COMMANDE ÉLECTRONIQUE
(JA) 車載マルチコア制御用データ伝達装置および電子制御装置
Abstract:
(EN) In order to enable a data set for which synchronicity has been maintained to be transferred between cores in a multi-core system while improving the real-time characteristic of processing by the cores, even when the cores operate asynchronously, the present invention is provided with bank memories B(1) – B(5), and a writing core 601 and reading cores 602-1, 602-2, and 602-3 capable of accessing these bank memories B(1) – (B5). Furthermore, an access control unit 603 assigns only the one writing memory 601 to the bank memories B(1) – B(5) to which writing is being carried out, assigns one or more of the reading cores 602-1, 602-2, and 602-3 to the bank memories B(1) – B(5) from which reading is being carried out, and controls access to the bank memories B(1) – B(5) in an asynchronous manner such that the bank memories B(1) – B(5) to which writing is being carried out and the bank memories B(1) – B(5) from which reading is being carried out are not the same.
(FR) Selon l'invention, afin de permettre le transfert d'un ensemble de données pour lequel la synchronicité a été maintenue entre des cœurs dans un système multicœur tout en améliorant les caractéristiques en temps réel du traitement par les cœurs, même lorsque les cœurs fonctionnent de manière asynchrone, la présente invention est pourvue de mémoires en banques (B(1) - B(5)), et d'un cœur d'écriture (601) et de cœurs de lecture (602-1, 602-2, et 602-3) capables d'accéder à ces mémoires en banques (B(1) - (B5)). En outre, une unité de commande d'accès (603) attribue uniquement la seule mémoire d'écriture (601) aux mémoires en banques (B(1) - B (5)) sur lesquelles l'écriture est réalisée, attribue un ou plusieurs des cœurs de lecture (602-1, 602-2, et 602-3) aux mémoires en banques (B(1) - B(5)) sur lesquelles la lecture est réalisée, et commande l'accès aux mémoires en banques (B(1) - B(5)) de manière asynchrone de sorte que les mémoires en banques (B(1) - B(5)) sur lesquelles l'écriture est réalisée et les mémoires en banques (B(1) - B(5)) sur lesquels la lecture est réalisée ne soient pas les mêmes.
(JA) マルチコアシステムにおけるコアが非同期に動作する場合おいても、コアによる処理のリアルタイム性を向上させつつ、同時性が確保されたデータセットをコア間で伝達する。バンクメモリB[1]~B[5]と、これらのバンクメモリB[1]~B[5]にアクセス可能な書き込みコア601および読み出しコア602-1、602-2、602-3が設けられ、アクセス制御部603は、書き込みが行われるバンクメモリB[1]~B[5]には、1個の書き込みコア601のみを割り当て、読み出しが行われるバンクメモリB[1]~B[5]には、1以上の読み出しコア602-1、602-2、602-3読を割り当て、書き込みが行われているバンクメモリB[1]~B[5]と読み出しが行われているバンクメモリB[1]~B[5]とが同一にならないようにバンクメモリB[1]~B[5]へのアクセスを排他的に制御する。
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Publication Language: Japanese (JA)
Filing Language: Japanese (JA)