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1. (WO2019061480) PREEMPTIVE IDLE TIME READ SCANS
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Pub. No.: WO/2019/061480 International Application No.: PCT/CN2017/104945
Publication Date: 04.04.2019 International Filing Date: 30.09.2017
IPC:
G06F 12/16 (2006.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
12
Accessing, addressing or allocating within memory systems or architectures
16
Protection against loss of memory contents
Applicants:
MICRON TECHNOLOGY, INC. [US/US]; 8000 South Federal Way Boise, ID 83716-9632, US
Inventors:
MALSHE, Ashutosh; US
SINGIDI, Harish; US
MUCHHERLA, Kishore, Kumar; US
MILLER, Michael, G.; US
RATNAM, Sampath; US
ZHANG, John; CN
ZHOU, Jie; CN
Agent:
LEE AND LI - LEAVEN IPR AGENCY LTD.; Unit 2202, Tower A, Beijing Marriott Center No. 7, Jian Guo Men South Avenue Beijing 100005, CN
Priority Data:
Title (EN) PREEMPTIVE IDLE TIME READ SCANS
(FR) BALAYAGES DE LECTURE PRÉEMPTIFS EN PÉRIODE D'INACTIVITÉ
Abstract:
(EN) Devices and techniques for initiating and controlling preemptive idle time read scans in a flash based storage system are disclosed. In an example, a memory device includes a NAND memory array and a memory controller to schedule and initiate read scans among multiple locations of the memory array, with such read scans being preemptively triggered during an idle (background) state of the memory device, thus reducing host latency during read and write operations in an active (foreground) state of the memory device. In an example, the optimization technique includes scheduling a read scan operation, monitoring an active or idle state of host 10 operations, and preemptively initiating the read scan operation when entering an idle state, before the read scan operation is scheduled to occur, in further examples, the read scan may preemptively occur based on time-based scheduling, frequency-based conditions, or event-driven conditions triggering the read scan.
(FR) L'invention concerne des dispositifs et des techniques destinés à lancer et à commander des balayages de lecture préemptifs en période d'inactivité dans un système de stockage sur base Flash. Dans un exemple, un dispositif de mémoire comprend un réseau de mémoire NON ET et un contrôleur de mémoire pour programmer et lancer des balayages de lecture parmi des emplacements multiples du réseau de mémoire, lesdits balayages de lecture étant déclenchés de manière préemptive pendant un état inactif (arrière-plan) du dispositif de mémoire, réduisant ainsi la latence de l'hôte pendant les opérations de lecture et d'écriture dans un état actif (de premier plan) du dispositif de mémoire. Dans un exemple, la technique d'optimisation comprend les étapes consistant à programmer une opération de balayage de lecture, à surveiller un état actif ou inactif des opérations de l'hôte, et à lancer de manière préemptive l'opération de balayage de lecture lors du passage à un état inactif, avant le moment où il est programmé que l'opération de balayage de lecture ait lieu, dans d'autres exemples, le balayage de lecture peut avoir lieu de manière préemptive selon une programmation basée sur le temps, des conditions basées sur la fréquence, ou des conditions pilotées par des événements et déclenchant le balayage de lecture.
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Publication Language: English (EN)
Filing Language: English (EN)