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1. (WO2019061330) POWER ENHANCED STACKED CHIP SCALE PACKAGE SOLUTION WITH INTEGRATED DIE ATTACH FILM
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Pub. No.: WO/2019/061330 International Application No.: PCT/CN2017/104496
Publication Date: 04.04.2019 International Filing Date: 29.09.2017
IPC:
H01L 25/00 (2006.01)
H ELECTRICITY
01
BASIC ELECTRIC ELEMENTS
L
SEMICONDUCTOR DEVICES; ELECTRIC SOLID STATE DEVICES NOT OTHERWISE PROVIDED FOR
25
Assemblies consisting of a plurality of individual semiconductor or other solid state devices
Applicants:
XU, Zhijun [CN/CN]; CN (BZ)
LIU, Bin [CN/CN]; CN (BZ)
SHE, Yong [CN/CN]; CN (BZ)
DING, Zhicheng [CN/CN]; CN (BZ)
INTEL CORPORATION [US/US]; 2200 Mission College Blvd. Santa Clara, California 95054, US
Inventors:
XU, Zhijun; CN
LIU, Bin; CN
SHE, Yong; CN
DING, Zhicheng; CN
Agent:
NTD PATENT AND TRADEMARK AGENCY LIMITED; 中国北京市 东城区北三环东路36号北京环球贸易中心C座10层 10th Floor, Tower C, Beijing Global Trade Center 36 North Third Ring Road East, Dongcheng District Beijing 100013, CN
Priority Data:
Title (EN) POWER ENHANCED STACKED CHIP SCALE PACKAGE SOLUTION WITH INTEGRATED DIE ATTACH FILM
(FR) SOLUTION DE CONDITIONNEMENT À L’ÉCHELLE DE PUCES EMPILÉES RENFORCÉES DE PUISSANCE À PELLICULE D’ATTACHE DE MATRICE INTÉGRÉE
Abstract:
(EN) An apparatus comprising: a die stack comprising at least one die pair, the at least one die pair having a first die over a second die, the first die and the second die both having a first surface and a second surface, the second surface of the first die over the first surface of the second die; and an adhesive film between the first die and the second die of the at least one die pair; wherein the adhesive film comprises an insulating layer and a conductive layer, the insulating layer adhering to the second surface of the first die and the conductive layer adhering to the first surface of the second die.
(FR) L’invention concerne un appareil comprenant : un empilement de matrices comprenant au moins une paire de matrices, la ou les paires de matrices ayant une première matrice sur une deuxième matrice, la première matrice et la deuxième matrice ayant toutes les deux une première surface et une deuxième surface, la deuxième surface de la première matrice au-dessus de la première surface de la deuxième matrice ; et une pellicule adhésive entre la première matrice et la deuxième matrice de la paire ou des paires de matrices ; la pellicule adhésive comprenant une couche isolante et une couche conductrice, la couche isolante adhérant à la deuxième surface de la première matrice et la couche conductrice adhérant à la première surface de la deuxième matrice.
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Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
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European Patent Office (EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Publication Language: English (EN)
Filing Language: English (EN)