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1. (WO2019047605) METHOD FOR SYNCHRONIZING MULTI-OCULAR CAMERA, AND FPGA CHIP
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Pub. No.: WO/2019/047605 International Application No.: PCT/CN2018/094492
Publication Date: 14.03.2019 International Filing Date: 04.07.2018
IPC:
H04N 5/04 (2006.01)
H ELECTRICITY
04
ELECTRIC COMMUNICATION TECHNIQUE
N
PICTORIAL COMMUNICATION, e.g. TELEVISION
5
Details of television systems
04
Synchronising
Applicants:
百度在线网络技术(北京)有限公司 BAIDU ONLINE NETWORK TECHNOLOGY (BEIJING) CO., LTD. [CN/CN]; 中国北京市 海淀区上地十街10号百度大厦三层 3/F Baidu Campus No. 10, Shangdi 10th Street, Haidian District Beijing 100085, CN
Inventors:
张云飞 ZHANG, Yunfei; CN
郁浩 YU, Hao; CN
闫泳杉 YAN, Yongshan; CN
郑超 ZHENG, Chao; CN
唐坤 TANG, Kun; CN
姜雨 JIANG, Yu; CN
Agent:
北京英赛嘉华知识产权代理有限责任公司 INSIGHT INTELLECTUAL PROPERTY LIMITED; 中国北京市 海淀区知春路甲48号盈都大厦A座19A 19 A, Tower A, InDo Building No. 48A Zhichun Road, Haidian District Beijing 100098, CN
Priority Data:
201710792881.905.09.2017CN
Title (EN) METHOD FOR SYNCHRONIZING MULTI-OCULAR CAMERA, AND FPGA CHIP
(FR) PROCÉDÉ DE SYNCHRONISATION DE CAMÉRA MULTIOCULAIRE, ET PUCE FPGA
(ZH) 对多目相机进行同步的方法和FPGA芯片
Abstract:
(EN) The present invention aims to provide a method for synchronizing a multi-ocular camera, and an FPGA chip. The method of the present invention comprises the following steps: acquiring in parallel, on the basis of an n-multiple frequency clock, pixel values of n cameras of the multi-ocular camera, the n cameras all using a 1-multiple frequency pixel clock; and storing in parallel, on the basis of the n-multiple frequency clock, the obtained pixel values of the cameras. The solution of the present invention, by using parallel operation characteristics of an FPGA, is able to obtain pixel values of cameras of a multi-ocular camera within one pixel clock, and perform encoding and storage within one pixel clock.
(FR) La présente invention vise à proposer un procédé de synchronisation d'une caméra multioculaire, et une puce FPGA. Le procédé de la présente invention comprend les étapes suivantes : acquisition en parallèle, sur la base d'une horloge à fréquence n-ième multiple, de valeurs de pixel de n caméras de la caméra multioculaire, les n caméras utilisant toutes une horloge de pixel à fréquence 1er multiple ; et le stockage en parallèle, sur la base de l'horloge à fréquence n-ième multiple, des valeurs de pixel obtenues des caméras. La solution de la présente invention, en utilisant des caractéristiques de fonctionnement en parallèle d'un FPGA, peut obtenir des valeurs de pixel des caméras d'une caméra multioculaire dans une période d'horloge de pixel, et effectuer un codage et un stockage dans une période d'horloge de pixel.
(ZH) 本发明的目的是提供一种对多目相机进行同步的方法和FPGA芯片。本发明的方法包括以下步骤:基于n倍频时钟,并行地获取来自所述多目相机中n个相机的像素值,其中,所述n个相机均采用1倍频的像素时钟;基于所述n倍频时钟,并行存储所获得的各个相机的像素值。根据本发明的方案,通过利用FPGA的并行操作特性,能够在一个像素时钟内获得来自多目相机中各个相机的像素值,并在一个像素时钟内进行编码存储。
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Publication Language: Chinese (ZH)
Filing Language: Chinese (ZH)