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1. (WO2019046326) READ VOLTAGE CALIBRATION BASED ON HOST IO OPERATIONS
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Pub. No.: WO/2019/046326 International Application No.: PCT/US2018/048383
Publication Date: 07.03.2019 International Filing Date: 28.08.2018
IPC:
G11C 16/26 (2006.01) ,G11C 16/30 (2006.01)
G PHYSICS
11
INFORMATION STORAGE
C
STATIC STORES
16
Erasable programmable read-only memories
02
electrically programmable
06
Auxiliary circuits, e.g. for writing into memory
26
Sensing or reading circuits; Data output circuits
G PHYSICS
11
INFORMATION STORAGE
C
STATIC STORES
16
Erasable programmable read-only memories
02
electrically programmable
06
Auxiliary circuits, e.g. for writing into memory
30
Power supply circuits
Applicants:
MICRON TECHNOLOGY, INC. [US/US]; 8000 So. Federal Way Boise, Idaho 83716-9632, US
RATNAM, Sampath [IN/US]; US
TANPAIROJ, Kulachet [US/US]; US
Inventors:
RATNAM, Sampath; US
TANPAIROJ, Kulachet; US
MALSHE, Ashutosh; US
MUCHHERLA, Kishore Kumar; US
SINGIDI, Harish Reddy; US
FEELEY, Peter Sean; US
LUO, Ting; US
Priority Data:
15/689,74729.08.2017US
Title (EN) READ VOLTAGE CALIBRATION BASED ON HOST IO OPERATIONS
(FR) ÉTALONNAGE DE TENSION DE LECTURE SUR LA BASE D'OPÉRATIONS ES HÔTES
Abstract:
(EN) Devices and techniques for read voltage calibration of a flash-based storage system based on host IO operations are disclosed. In an example, a memory device includes a NAND memory array having groups of multiple blocks of memory cells, and a memory controller to optimize voltage calibration for reads of the memory array. In an example, the optimization technique includes monitoring read operations occurring to a respective block, identifying a condition to trigger a read level calibration based on the read operations, and performing the read level calibration for the respective block or a memory component that includes the respective block. In a further example, the calibration is performed based on a threshold voltage to read the respective block, which may be considered when the threshold voltage to read the respective block is evaluated within a sampling operation performed by the read level calibration.
(FR) L'invention concerne des dispositifs et des techniques pour l'étalonnage de tension de lecture d'un système de stockage basé sur flash sur la base d'opérations ES hôtes. Dans un exemple, un dispositif de mémoire comprend un réseau de mémoire NON-ET comportant des groupes de multiples blocs de cellules de mémoire, et un dispositif de commande de mémoire afin d'optimiser l'étalonnage de tension pour des lectures du réseau de mémoire. Dans un exemple, la technique d'optimisation comprend la surveillance d'opérations de lecture se produisant dans un bloc respectif, l'identification d'une condition pour déclencher un étalonnage de niveau de lecture sur la base des opérations de lecture, et la réalisation de l'étalonnage de niveau de lecture pour le bloc respectif ou un composant de mémoire qui comprend le bloc respectif. Dans un autre exemple, l'étalonnage est effectué sur la base d'une tension de seuil afin de lire le bloc respectif, ce qui peut être pris en compte lorsque la tension de seuil pour lire le bloc respectif est évaluée dans une opération d'échantillonnage effectuée par l'étalonnage de niveau de lecture.
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Publication Language: English (EN)
Filing Language: English (EN)