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1. (WO2019026643) COMMUNICATION APPARATUS, COMMUNICATION METHOD, PROGRAM, AND COMMUNICATION SYSTEM
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Pub. No.: WO/2019/026643 International Application No.: PCT/JP2018/027242
Publication Date: 07.02.2019 International Filing Date: 20.07.2018
IPC:
G06F 13/42 (2006.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
13
Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
38
Information transfer, e.g. on bus
42
Bus transfer protocol, e.g. handshake; Synchronisation
Applicants:
SONY SEMICONDUCTOR SOLUTIONS CORPORATION [JP/JP]; 4-14-1, Asahi-cho, Atsugi-shi, Kanagawa 2430014, JP
Inventors:
TAKAHASHI Hiroo; JP
KOSHISAKA Naohiro; JP
Agent:
NISHIKAWA Takashi; JP
INAMOTO Yoshio; JP
Priority Data:
2017-15206204.08.2017JP
Title (EN) COMMUNICATION APPARATUS, COMMUNICATION METHOD, PROGRAM, AND COMMUNICATION SYSTEM
(FR) APPAREIL DE COMMUNICATION, PROCÉDÉ DE COMMUNICATION, PROGRAMME ET SYSTÈME DE COMMUNICATION
Abstract:
(EN) Communication is performed more reliably. A CCI (I3C DDR) processing section determines status of an index when requested to be accessed by an I3C master for a read operation. An error handling section then controls an I3C slave 13 to detect occurrence of an error based on the status of the index and to neglect all communication until DDR mode is stopped or restarted by the I3C master, the I3C slave 13 being further controlled to send a NACK response when performing acknowledge processing on a signal sent from the I3C master. This technology can be applied to the I3C bus, for example.
(FR) La présente invention concerne une communication qui est réalisée de manière plus fiable. Une section de traitement CCI (I3C DDR) détermine l'état d'un index en cas de demande d'accès par un maître I3C pour une opération de lecture. Une section de traitement d'erreur commande ensuite un esclave I3C (13) afin de détecter l'apparition d'une erreur sur la base de l'état d'index et de refuser toutes les communications jusqu'à ce que le mode DDR soit arrêté ou redémarré par le maître I3C, l'esclave I3C (13) étant en outre commandé pour envoyer une réponse NACK lors du traitement d'accusé de réception sur un signal envoyé par le maître I3C. La technologie de la présente invention peut par exemple être appliquée à un bus I3C.
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Publication Language: English (EN)
Filing Language: English (EN)