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1. (WO2018125399) MEMORY CONTROLLER CAPABLE OF PERFORMING SCHEDULED MEMORY MAINTENANCE FROM A SLEEP STATE
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Pub. No.: WO/2018/125399 International Application No.: PCT/US2017/061361
Publication Date: 05.07.2018 International Filing Date: 13.11.2017
IPC:
G06F 1/32 (2006.01) ,H03L 7/08 (2006.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
1
Details not covered by groups G06F3/-G06F13/82
26
Power supply means, e.g. regulation thereof
32
Means for saving power
H ELECTRICITY
03
BASIC ELECTRONIC CIRCUITRY
L
AUTOMATIC CONTROL, STARTING, SYNCHRONISATION, OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
7
Automatic control of frequency or phase; Synchronisation
06
using a reference signal applied to a frequency- or phase-locked loop
08
Details of the phase-locked loop
Applicants:
INTEL CORPORATION [US/US]; Intel Corporation 2200 Mission College Blvd Santa Clara, California 95054, US
Inventors:
RADJAI, Amir Ali; US
KAPADIA, Bezan; MD
Agent:
O'ROURKE, Robert B.; US
ALDOUS, Alan; US
HODGE, Julia; US
Priority Data:
15/392,82128.12.2016US
Title (EN) MEMORY CONTROLLER CAPABLE OF PERFORMING SCHEDULED MEMORY MAINTENANCE FROM A SLEEP STATE
(FR) CONTRÔLEUR DE MÉMOIRE SUSCEPTIBLE DE RÉALISER UNE MAINTENANCE DE MÉMOIRE PROGRAMMÉE À PARTIR D'UN MODE VEILLE
Abstract:
(EN) A method is described. The method includes periodically maintaining memory devices with circuitry of a memory controller. The circuitry is to act in response to signals from timer and scheduling circuitry that determine when memory maintenance is to occur to which of the memory devices. The periodically maintaining is performed while the memory controller is able to perform read/write operations from/to the memory devices. The method also includes placing the memory controller into a sleep mode in which the memory controller is not able to read/write from/to the memory devices, where, the periodically maintaining continues to be performed while the memory controller is within the sleep mode.
(FR) La présente invention concerne un procédé. Le procédé consiste à maintenir périodiquement des dispositifs de mémoire avec un ensemble de circuits d'un contrôleur de mémoire. L'ensemble de circuits doit agir en réponse à des signaux provenant d'un temporisateur et d'un ensemble de circuits de planification qui déterminent sur lequel des dispositifs de mémoire une maintenance de mémoire doit se produire. Le maintien périodique est réalisé tandis que le contrôleur de mémoire peut réaliser des opérations de lecture/écriture depuis/vers les dispositifs de mémoire. Le procédé comprend également le placement du contrôleur de mémoire dans un mode veille dans lequel le contrôleur de mémoire n'est pas capable de lire/écrire depuis/vers les dispositifs de mémoire, où, le maintien périodique continue d'être réalisé tandis que le contrôleur de mémoire est dans le mode veille.
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Publication Language: English (EN)
Filing Language: English (EN)