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1. (WO2018120297) GOA DRIVE CIRCUIT, AND DISPLAY DEVICE
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Pub. No.: WO/2018/120297 International Application No.: PCT/CN2017/071002
Publication Date: 05.07.2018 International Filing Date: 12.01.2017
IPC:
G09G 3/36 (2006.01)
G PHYSICS
09
EDUCATING; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
G
ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
3
Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
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for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix
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by control of light from an independent source
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using liquid crystals
Applicants:
深圳市华星光电技术有限公司 SHENZHEN CHINA STAR OPTOELECTRONICS TECHNOLOGY CO., LTD. [CN/CN]; 中国广东省深圳市 光明新区塘明大道9-2号 No.9-2, Tangming Road, Guangming Shenzhen, Guangdong 518132, CN
Inventors:
石龙强 SHI, Longqiang; CN
Agent:
深圳市铭粤知识产权代理有限公司 MING & YUE INTELLECTUAL PROPERTY LAW FIRM; 中国广东省深圳市南山区南山街道前海路泛海城市广场2栋604室 Room 604 Building 2, Oceanwide City Square, Qianhai Road, Nanshan Street, Nanshan District Shenzhen, Guangdong 518066, CN
Priority Data:
201611259806.830.12.2016CN
Title (EN) GOA DRIVE CIRCUIT, AND DISPLAY DEVICE
(FR) CIRCUIT D'ATTAQUE DE GOA ET DISPOSITIF D'AFFICHAGE
(ZH) GOA驱动电路及显示装置
Abstract:
(EN) Disclosed is a GOA drive circuit, comprising N cascaded GOA units, wherein N is a natural number not less than 4, an i-th stage GOA unit comprises a first transistor (T1), a second transistor (T2), a third transistor (T3), a first capacitor (C1), and a first pull-down holding unit (10), with 1 ≤ ia, and a being a natural number less than or equal to N/2, and a j-th stage GOA unit comprises a fourth transistor (T1), a fifth transistor (T5), a second capacitor (C2), and a second pull-down holding unit (20), with a+1 ≤ jN. The GOA drive circuit of the present invention reduces data buffering time, thus reducing a cost of the GOA drive circuit.
(FR) L'invention concerne un circuit d'attaque de GOA comprenant N unités de GOA en cascade, N étant un nombre naturel supérieur ou égal à 4, une unité GOA d'i-ième étage comprenant un premier transistor (T1), un deuxième transistor (T2), un troisième transistor (T3), un premier condensateur (C1) et une première unité de maintien de rappel à la masse (10), avec 1 ≤ ia, et a étant un nombre naturel inférieur ou égal à N/2, et une unité GOA de j-ième étage comprenant un quatrième transistor (T1), un cinquième transistor (T5), un second condensateur (C2) et une seconde unité de maintien de rappel à la masse (20), avec a+1 ≤ jN. Le circuit d'attaque de GOA de la présente invention permet de réduire le temps de mise en mémoire tampon de données, ce qui permet de réduire le coût du circuit d'attaque de GOA.
(ZH) 公开了一种GOA驱动电路,包括级连的N个GOA单元,其中N为不小于4的自然数,第i级GOA单元包括:第一晶体管(T1)、第二晶体管(T2)、第三晶体管(T3)、第一电容器(C1)、第一下拉维持单元(10),其中1≤i≤a,a为小于或等于N/2的自然数;第j级GOA单元包括:第四晶体管(T1)、第五晶体管(T5)、第二电容器(C2)、第二下拉维持单元(20),其中a+1≤j≤N。该GOA驱动电路能够缩短数据缓冲时间,从而有利于GOA驱动电路成本的降低。
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Publication Language: Chinese (ZH)
Filing Language: Chinese (ZH)