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1. (WO2018105333) MULTILAYER CERAMIC SUBSTRATE AND ELECTRONIC DEVICE
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Pub. No.: WO/2018/105333 International Application No.: PCT/JP2017/040930
Publication Date: 14.06.2018 International Filing Date: 14.11.2017
IPC:
H05K 3/46 (2006.01) ,H01L 23/15 (2006.01)
Applicants: MURATA MANUFACTURING CO., LTD.[JP/JP]; 10-1, Higashikotari 1-chome, Nagaokakyo-shi, Kyoto 6178555, JP
Inventors: FUJITA, Seiji; JP
Agent: YASUTOMI & ASSOCIATES; 5-36, Miyahara 3-chome, Yodogawa-ku, Osaka-shi, Osaka 5320003, JP
Priority Data:
2016-23852508.12.2016JP
Title (EN) MULTILAYER CERAMIC SUBSTRATE AND ELECTRONIC DEVICE
(FR) SUBSTRAT CÉRAMIQUE MULTICOUCHE ET DISPOSITIF ÉLECTRONIQUE
(JA) 多層セラミック基板及び電子装置
Abstract: front page image
(EN) This multilayer ceramic substrate has a laminated structure comprising a surface layer section positioned on the surface, and an inner layer section positioned further toward inside than the surface layer section, said multilayer ceramic substrate having a surface layer electrode that is provided on the surface of the surface layer section. The multilayer ceramic substrate is characterized in that: the surface layer section includes a first layer adjacent to the inner layer section; the inner layer section includes a second layer adjacent to the first layer; in the first layer, the porosity is 13 % or lower, and the maximum pore diameter is 10 μm or smaller; and in the second layer, the porosity is 14 % or lower, and the maximum pore diameter is 11 μm or smaller.
(FR) Selon la présente invention, ce substrat céramique multicouche a une structure stratifiée comprenant une section de couche de surface positionnée sur la surface, et une section de couche interne positionnée plus à l'intérieur que la section de couche de surface, ledit substrat céramique multicouche ayant une électrode de couche de surface qui est disposée sur la surface de la section de couche de surface. Le substrat céramique multicouche est caractérisé en ce que : la section de couche de surface comprend une première couche adjacente à la section de couche interne ; la section de couche interne comprend une seconde couche adjacente à la première couche ; dans la première couche, la porosité est de 13 % ou moins, et le diamètre de pore maximal est de 10 µm ou moins ; et dans la seconde couche, la porosité est de 14 % ou moins, et le diamètre de pore maximal est de 11 µm ou moins.
(JA) 本発明の多層セラミック基板は、表面に位置する表層部と上記表層部より内側に位置する内層部とからなる積層構造を有し、上記表層部の表面に表層電極が設けられた多層セラミック基板であって、上記表層部は、上記内層部に隣接する第1層を含み、上記内層部は、上記第1層に隣接する第2層を含み、上記第1層のポア率が13%以下、最大ポア径が10μm以下であり、上記第2層のポア率が14%以下、最大ポア径が11μm以下であることを特徴とする。
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
African Regional Intellectual Property Organization (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Office (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Publication Language: Japanese (JA)
Filing Language: Japanese (JA)