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1. (WO2018100902) IMAGING DEVICE
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Pub. No.:    WO/2018/100902    International Application No.:    PCT/JP2017/037371
Publication Date: 07.06.2018 International Filing Date: 16.10.2017
IPC:
H04N 5/367 (2011.01), H04N 17/00 (2006.01)
Applicants: SONY SEMICONDUCTOR SOLUTIONS CORPORATION [JP/JP]; 4-14-1 Asahi-cho, Atsugi-shi, Kanagawa 2430014 (JP)
Inventors: KAWAZU, Naoki; (JP).
TORII, Motonobu; (JP).
MOTOHASHI, Yuichi; (JP).
SUZUKI, Atsushi; (JP).
AZAMI, Junichiro; (JP)
Agent: MARUSHIMA, Toshikazu; (JP)
Priority Data:
2016-233875 01.12.2016 JP
Title (EN) IMAGING DEVICE
(FR) DISPOSITIF D'IMAGERIE
Abstract: front page image
(EN)A first pixel comprises a first transfer transistor, a first reset transistor, a first amplifier transistor and a first select transistor. The first transfer transistor has a first terminal coupled to a reference signal generation circuit. The first reset transistor has a first terminal coupled to the reference signal generation circuit. The first amplifier transistor has a gate coupled to a second terminal of the first reset transistor and a second terminal of the first transfer transistor. The first select transistor is coupled to the first amplifier transistor. A second pixel comprises a first photoelectric conversion element, a second transfer transistor coupled to the first photoelectric conversion element, a second reset transistor configured to receive a first predetermined voltage, a second amplifier transistor coupled to the second transfer transistor and the second reset transistor, and a second select transistor coupled to the second amplifier transistor.
(FR)Un premier pixel comprend un premier transistor de transfert, un premier transistor de réinitialisation, un premier transistor amplificateur et un premier transistor de sélection. Le premier transistor de transfert a une première borne couplée à un circuit de génération de signal de référence. Le premier transistor de réinitialisation a une première borne couplée au circuit de génération de signal de référence. Le premier transistor amplificateur a une grille couplée à une seconde borne du premier transistor de réinitialisation et à une seconde borne du premier transistor de transfert. Le premier transistor de sélection est couplé au premier transistor amplificateur. Un second pixel comprend un premier élément de conversion photoélectrique, un second transistor de transfert couplé au premier élément de conversion photoélectrique, un second transistor de réinitialisation configuré pour recevoir une première tension prédéterminée, un second transistor amplificateur couplé au second transistor de transfert et au second transistor de réinitialisation, et un second transistor de sélection couplé au second transistor amplificateur.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)