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1. (WO2018058964) GATE INTEGRATED DRIVING CIRCUIT AND DRIVING METHOD THEREOF, AND DISPLAY APPARATUS
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Pub. No.:    WO/2018/058964    International Application No.:    PCT/CN2017/084330
Publication Date: 05.04.2018 International Filing Date: 15.05.2017
IPC:
G09G 3/20 (2006.01), H03K 17/284 (2006.01)
Applicants: BOE TECHNOLOGY GROUP CO., LTD. [CN/CN]; No. 10 Jiuxianqiao Rd., Chaoyang District Beijing 100015 (CN).
HEFEI XINSHENG OPTOELECTRONICS TECHNOLOGY CO., LTD. [CN/CN]; Xinzhan Industrial Park Hefei, Anhui 230012 (CN)
Inventors: HE, Min; (CN).
XU, Haixia; (CN).
HAN, Dongxu; (CN).
LI, Meng; (CN)
Agent: TEE & HOWE INTELLECTUAL PROPERTY ATTORNEYS; Yuan CHEN 10th Floor, Tower D, Minsheng Financial Center 28 Jianguomennei Avenue, Dongcheng District Beijing 100005 (CN)
Priority Data:
201610860672.9 28.09.2016 CN
Title (EN) GATE INTEGRATED DRIVING CIRCUIT AND DRIVING METHOD THEREOF, AND DISPLAY APPARATUS
(FR) CIRCUIT DE PILOTAGE INTÉGRÉ DE GRILLE ET SON PROCÉDÉ DE PILOTAGE ET APPAREIL D’AFFICHAGE
Abstract: front page image
(EN)A gate integrated driving circuit for a display panel. The gate integrated driving circuit may comprise N reset circuits (10). For each of the N reset circuits (10), a first terminal thereof may be coupled to a reference signal terminal, a second terminal thereof may be coupled to signal output terminals of a set of input and output circuits respectively, a third terminal thereof may be coupled to control terminals of driving circuits of the set of input and output circuits respectively, and a fourth terminal thereof may be coupled to a clock signal terminal coupled to input terminals of the driving circuits of the set of input and output circuits respectively. N may be an integer of at least 3. The set of input and output circuits may contain two or more input and output circuits.
(FR)L'invention concerne un circuit de pilotage intégré de grille pour un panneau d'affichage. Le circuit de pilotage intégré de grille peut comprendre N circuits de réinitialisation (10). Pour chacun des N circuits de réinitialisation (10), une première borne dudit circuit peut être accouplée à une borne de signal de référence, une deuxième borne dudit circuit peut être accouplée à des bornes de sortie de signal d'un ensemble de circuits d'entrée et de sortie respectivement, une troisième borne dudit circuit peut être accouplée à des bornes de commande de circuits de pilotage de l'ensemble de circuits d'entrée et de sortie respectivement et une quatrième borne dudit circuit peut être accouplée à une borne de signal d'horloge accouplée à des bornes d'entrée des circuits de pilotage de l'ensemble de circuits d'entrée et de sortie respectivement. N peut être un entier d'au moins 3. L'ensemble de circuits d'entrée et de sortie peut contenir au moins deux circuits d'entrée et de sortie.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)