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1. (WO2018057204) PAPR REDUCTION FOR IQ RFDAC
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Pub. No.:    WO/2018/057204    International Application No.:    PCT/US2017/048116
Publication Date: 29.03.2018 International Filing Date: 23.08.2017
IPC:
H04L 27/26 (2006.01), H04L 27/34 (2006.01), H03M 1/66 (2006.01)
Applicants: INTEL IP CORPORATION [US/US]; 2200 Mission College Boulevard Santa Clara, California 95054 (US)
Inventors: MAYER, Christian; (AT).
KUTTNER, Franz; (AT)
Agent: PERDOK, Monique M.; (US).
BLACK, David W., Reg. No. 42,331; (US).
BEEKMAN, Marvin L., Reg. No. 38,377; (US).
ARORA, Suneel, Reg. No. 42,267; (US).
BIANCHI, Timothy E., Reg. No. 39,610; (US).
WOO, Justin N., Reg. No. 62,686; (US).
MCCRACKIN, Ann M., Reg. No. 42,858; (US).
GOULD, James R., Reg. No. 72,086; (US).
SCHEER, Bradley W., Reg. No. 47,059; (US)
Priority Data:
15/274,721 23.09.2016 US
Title (EN) PAPR REDUCTION FOR IQ RFDAC
(FR) RÉDUCTION DE PAPR POUR RFDAC IQ
Abstract: front page image
(EN)Disclosed herein is an apparatus and methodology for reducing peak-to-average-power ratio (PAPR) for IQ radio frequency digital-to-analog converter (RFDAC). Processing circuitry may be configured to generate a digital signal comprising an in-phase (I) signal component and a quadrature (Q) signal component having a peak-to-average-power-ratio (PAPR). The processing circuitry may determine the I signal component and the Q signal component are higher than a predetermined threshold value, and limit the I signal component and the Q signal component to be less than or equal to the predetermined threshold value. The processing circuitry may rotate the signal components to generate rotated signal components to reduce the PAPR based on the I and Q signal components having less than or equal to the predetermined threshold value, and may generate an output radio frequency (RF) signal based on the rotated signal components.
(FR)L'invention concerne un appareil et une méthodologie pour réduire le rapport de la puissance de crête à la puissance moyenne (PAPR) pour un convertisseur numérique-analogique radiofréquence (RFDAC) IQ. Des circuits de traitement peuvent être configurés pour générer un signal numérique comprenant une composante de signal en phase (I) et une composante de signal en quadrature (Q) ayant un rapport de la puissance de crête à la puissance moyenne (PAPR). Les circuits de traitement peuvent déterminer que la composante de signal I et la composante de signal Q sont supérieures à une valeur seuil prédéterminée, et limiter la composante de signal I et la composante de signal Q à être inférieure ou égale à la valeur seuil prédéterminée. Les circuits de traitement peuvent faire tourner les composantes de signal pour générer des composantes de signal déphasé pour réduire le PAPR sur la base des composantes de signal I et Q ayant une valeur inférieure ou égale à la valeur seuil prédéterminée, et peuvent générer un signal radiofréquence de sortie (RF) sur la base des composantes de signal déphasé.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)