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1. (WO2018052690) MEMORY DEVICES AND ELECTRONIC SYSTEMS HAVING A HYBRID CACHE WITH STATIC AND DYNAMIC CELLS, AND RELATED METHODS
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Pub. No.:    WO/2018/052690    International Application No.:    PCT/US2017/048671
Publication Date: 22.03.2018 International Filing Date: 25.08.2017
IPC:
G06F 12/0873 (2016.01)
Applicants: MICRON TECHNOLOGY, INC. [US/US]; 8000 South Federal Way Mailstop 525 Boise, Idaho 83707 (US)
Inventors: MUCHHERLA, Kishore K.; (US).
MALSHE, Ashutosh; (US).
RATNAM, Sampath K.; (US).
FEELEY, Peter; (US).
MILLER, Michael G.; (US).
HALE, Christopher S.; (US).
PADILLA, Renato C.; (US)
Agent: GUTKE, Steven W.; (US).
WALKOWSKI, Joseph A.; (US).
GUNN, J. Jeffrey; (US).
BEZDJIAN, Daniel J.; (US).
HAMER, Katherine A.; (US).
BAKER, Gregory C.; (US).
WATSON, James C.; (US).
WHITLOCK, Nathan E.; (US).
FLORES, Jesse M; (US).
PULLEY, Stephen E.; (US).
SCHIERMAN, Elizabeth Herbst; (US).
BACA, Andrew J.; (US)
Priority Data:
15/269,518 19.09.2016 US
Title (EN) MEMORY DEVICES AND ELECTRONIC SYSTEMS HAVING A HYBRID CACHE WITH STATIC AND DYNAMIC CELLS, AND RELATED METHODS
(FR) DISPOSITIFS DE MÉMOIRE ET SYSTÈMES ÉLECTRONIQUES POSSÉDANT UNE MÉMOIRE CACHE HYBRIDE AVEC DES CELLULES STATIQUES ET DYNAMIQUES, ET PROCÉDÉS CONNEXES
Abstract: front page image
(EN)A memory device having a memory controller is configured to operate a hybrid cache including a dynamic cache including XLC blocks and a static cache including the SLC blocks. The memory controller is configured to disable at least one of the static cache or the dynamic cache. A method of operating a memory device includes partitioning a memory array into a first portion of SLC blocks and a second portion of XLC blocks, storing at least a portion of host data into the first portion of SLC blocks as a static cache; and storing at least another portion of the host data into the second portion of XLC blocks in an SLC mode as a dynamic cache responsive to a burst of host data being determined to be greater than the static cache can handle. Additional memory devices, methods, and computer systems are also described.
(FR)La présente invention concerne un dispositif de mémoire qui possède une unité de commande de mémoire. Ladite invention est configurée pour faire fonctionner une mémoire cache hybride qui comprend une mémoire cache dynamique qui comprend des blocs XLC et une mémoire cache statique qui comprend des blocs SLC. L'unité de commande de mémoire est configurée pour désactiver la mémoire cache statique et/ou la mémoire cache dynamique. Un procédé de fonctionnement d'un dispositif de mémoire comprend le partitionnement d'un réseau de mémoire en une première partie de blocs SLC et une seconde partie de blocs XLC, le stockage d'au moins une partie de données d'hôte dans la première partie de blocs SLC en tant que mémoire cache statique ; et le stockage d'au moins une autre partie des données d'hôte dans la seconde partie de blocs XLC dans un mode SLC en tant que mémoire cache dynamique en réponse à une rafale de données d'hôte déterminée comme étant supérieure à ce que la mémoire cache statique peut traiter. La présente invention concerne des dispositifs de mémoire, des procédés et des systèmes informatiques supplémentaires.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)