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1. (WO2018050847) RECTIFIER APPARATUS FOR RECTIFYING AN M-PHASE AC SIGNAL, AND OVERALL APPARATUS HAVING SUCH A RECTIFIER
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Pub. No.:    WO/2018/050847    International Application No.:    PCT/EP2017/073327
Publication Date: 22.03.2018 International Filing Date: 15.09.2017
IPC:
H02M 1/08 (2006.01), H02M 7/162 (2006.01), H02M 7/757 (2006.01), H03K 17/60 (2006.01), H03K 17/68 (2006.01)
Applicants: SEVA ACADEMY LTD. [MT/MT]; (MT).
PRAGMATEC GMBH [AT/AT]; Leutholdgasse 5 1220 Wien (AT)
Inventors: CHRYSTOWSKI, Chris W.; (DE)
Agent: MAIWALD PATENTANWALTS- UND RECHTSANWALTSGESELLSCHAFT MBH; Elisenhof / Elisenstr. 3 80335 München (DE)
Priority Data:
16189370.6 18.09.2016 EP
Title (DE) GLEICHRICHTER-VORRICHTUNG ZUM GLEICHRICHTEN EINES M-PHASIGEN WECHSELSIGNALS UND GESAMTVORRICHTUNG MIT EINEM SOLCHEN GLEICHRICHTER
(EN) RECTIFIER APPARATUS FOR RECTIFYING AN M-PHASE AC SIGNAL, AND OVERALL APPARATUS HAVING SUCH A RECTIFIER
(FR) DISPOSITIF REDRESSEUR POUR REDRESSER UN SIGNAL ALTERNATIF À M PHASES ET DISPOSITIF COMPLET COMPORTANT UN TEL REDRESSEUR
Abstract: front page image
(DE)Gleichrichter-Vorrichtung (20) zum Gleichrichten eines m-phasigen Wechselsignals, die m Gleichrichterschaltungen (40. m) umfasst, mit m als ganze Zahl ≥ 1. Die m Gleichrichterschaltungen (40. m) sind parallel zueinander angeordnet und sie umfassen eine Serienschaltung eines positiven Schaltungsbereichs (14) und eines negativen Schaltungsbereichs (15). Knoten (a1, a2, a3) dienen zum Einspeisen einer Phase des m-phasigen Wechselsignals an einem Verbindungsleiter (16, 17, 18), der sich zwischen dem positiven Schaltungsbereich (14) und dem negativen Schaltungsbereich (15) befindet. Mindestens eine der m Gleichrichterschaltungen (40. m) umfasst: - mindestens einen Feld-Effekt-Transistor (Q1, Q2, Q3), der im negativen Schaltungsbereich (15) angeordnet und dessen Drain (d) mit dem Knoten (a1, a2, a3) und dessen Source (s) mit einem unteren Potentialpunkt (k5) verbunden ist, - einen autosynchronen Treiber (aASD), der analog aufgebaut ist und der mit dem Gate (g) des mindestens einen Feld-Effekt-Transistors (Q1, Q2, Q3) verbunden ist, wobei der autosynchrone Treiber (aASD) dazu ausgelegt ist die entsprechende Phase des m-phasigen Wechselsignals zu überwachen und selbstständig einen Schaltvorgang des mindestens einen Feld-Effekt-Transistors (Q1, Q2, Q3) auszulösen, - mindestens eine Diode (DS1, DS2, DS3) die im positiven Schaltungsbereich (14) zwischen dem Knoten (a1, a2, a3) und einem oberen Potentialpunkt (k4) angeordnet ist, so, dass die Gleichrichter-Vorrichtung (20) ein Gleichsignal (+VD) bereit stellt, das zwischen dem oberen Potentialpunkt (k4) und dem unteren Potentialpunkt (k5) abgreifbar/entnehmbar ist.
(EN)A rectifier apparatus (20) for rectifying an m-phase AC signal, which comprises m rectifier circuits (40. m), where m is an integer ≥ 1. The m rectifier circuits (40. m) are arranged in parallel with one another and they comprise a series circuit comprising a positive circuit area (14) and a negative circuit area (15). Nodes (a1, a2, a3) are used to supply a phase of the m-phase AC signal to a connecting conductor (16, 17, 18) situated between the positive circuit area (14) and the negative circuit area (15). At least one of the m rectifier circuits (40. m) comprises: – at least one field-effect transistor (Q1, Q2, Q3), which is arranged in the negative circuit area (15) and the drain (d) of which is connected to the node (a1, a2, a3) and the source (s) of which is connected to a lower potential point (k5), – an autosynchronous driver (aASD), which is of analogue design and which is connected to the gate (g) of the at least one field-effect transistor (Q1, Q2, Q3), wherein the autosynchronous driver (aASD) is designed to monitor the applicable phase of the m-phase AC signal and to automatically trigger a switching process of the at least one field-effect transistor (Q1, Q2, Q3), – at least one diode (DS1, DS2, DS3) arranged in the positive circuit area (14) between the node (a1, a2, a3) and an upper potential point (k4), such that the rectifier apparatus (20) provides a DC signal (+VD) that can be tapped off/taken between the upper potential point (k4) and the lower potential point (k5).
(FR)L'invention concerne un dispositif redresseur (20) destiné à redresser un signal alternatif à m phases comprenant m circuits redresseurs (40. m), m étant un entier ≥ 1. Les m circuits redresseurs (40. m) sont disposés parallèlement les uns par rapport aux autres et comportent un circuit série constitué d'une zone de circuit positive (14) et d'une zone de circuit négative (15). Les nœuds (a1, a2, a3) servent à alimenter une phase du signal alternatif à m phases sur un conducteur de connexion (16, 17, 18) situé entre la zone de circuit positive (14) et la zone de circuit négative (15). Au moins un des m circuits redresseurs (40. m) comprend : - au moins un transistor à effet de champ (Q1, Q2, Q3) qui est disposé dans la zone de circuit négative (15), dont le drain (d) est relié au nœud (a1, a2, a3) et dont la source est reliée à un point de potentiel inférieur (k5), - un circuit d'attaque autosynchrone (aASD), de construction analogue, qui est relié à la grille (g) de l'au moins un transistor à effet de champ (Q1, Q2, Q3), le circuit d'attaque autosynchrone (aASD) étant conçu pour surveiller la phase correspondante du signal alternatif à m phases et déclencher indépendamment un processus de commutation de l'au moins un transistor à effet de champ (Q1, Q2, Q3), - au moins une diode (DS1, DS2, DS3) disposée dans la zone de circuit positive (14) entre le nœud (a1, a2, a3) et un point de potentiel supérieur (k4) de sorte que le dispositif redresseur (20) délivre un signal continu (+VD) qui peut être prélevé/pris entre le point de potentiel supérieur (k4) et le point de potentiel inférieur (k5).
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: German (DE)
Filing Language: German (DE)