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1. (WO2018031939) DISAGGREGATED FABRIC-SWITCHED COMPUTING UNITS
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Pub. No.:    WO/2018/031939    International Application No.:    PCT/US2017/046607
Publication Date: 15.02.2018 International Filing Date: 11.08.2017
IPC:
G06F 11/20 (2006.01), G06F 12/02 (2006.01), G06F 13/42 (2006.01), H04L 12/931 (2013.01)
Applicants: LIQID INC. [US/US]; 1408 Horizon Avenue, Suite 204 Lafayette, Colorado 80026 (US)
Inventors: BREAKSTONE, Jason; (US).
LONG, Christopher R.; (US).
CANNATA, James Scott; (US)
Agent: BOVITZ, David J.; (US).
ARMENT, Brian L.; (US).
ROCHE, Stephen S.; (US).
SETTER, Michael J.; (US)
Priority Data:
62/374,573 12.08.2016 US
62/468,231 07.03.2017 US
Title (EN) DISAGGREGATED FABRIC-SWITCHED COMPUTING UNITS
(FR) UNITÉS DE CALCUL DÉSAGRÉGÉES À COMMUTATION DE MATRICE
Abstract: front page image
(EN)Disaggregated computing architectures, platforms, and systems are provided herein. In one example, a method of operating compute units is presented that includes forming compute units among a plurality of physical computing components comprising at least central processing units (CPUs), storage modules, and network interface modules coupled over a Peripheral Component Interconnect Express (PCIe) fabric configured to communicatively couple the plurality of physical computing components and isolate the compute unit in the clustered environment using logical partitioning within the PCIe fabric. The method also includes initiating a software component deployed to at least associated CPUs within the compute units, reporting telemetry to the management processor related to operation of the compute unit, and emulating operation of an Ethernet interface to an operating system of the associated CPU for transfer of communications comprising at least the telemetry to the management processor over the PCIe fabric.
(FR)L'invention concerne des architectures, des plateformes et des systèmes de calcul désagrégés. Dans un exemple, un procédé de commande d'unités de calcul consiste à former des unités de calcul parmi une pluralité de composants de calcul physique comprenant au moins des unités centrales de traitement (UC), des modules de mémoire et des modules d'interface réseau couplés sur une matrice d'interface d'interconnexion de composants périphériques express (PCIe) configurée pour coupler en communication la pluralité de composants de calcul physique et isoler l'unité de calcul dans l'environnement en grappe à l'aide d'un partitionnement logique à l'intérieur de la matrice PCIe. Le procédé consiste également à lancer un composante logiciel déployé sur au moins des UC associées à l'intérieur des unités de calcul, à signaler la télémesure au processeur de gestion se rapportant au fonctionnement de l'unité de calcul, et à émuler le fonctionnement d'une interface Ethernet à un système d'exploitation de l'UC associée pour le transfert de communications comprenant au moins la télémétrie vers le processeur de gestion sur la matrice PCIe.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)