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1. (WO2018031904) COMPUTER AIDED DESIGN WITH HIGH RESOLUTION LATTICE STRUCTURES USING GRAPHICS PROCESSING UNITS (GPU)
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Pub. No.:    WO/2018/031904    International Application No.:    PCT/US2017/046539
Publication Date: 15.02.2018 International Filing Date: 11.08.2017
IPC:
G06F 17/50 (2006.01)
Applicants: SIEMENS PRODUCT LIFECYCLE MANAGEMENT SOFTWARE INC. [US/US]; 5800 Granite Parkway, Suite 600 Plano, Texas 75024-6612 (US)
Inventors: ALLEN, George; (CN).
MUSUVATHY, Suraj Ravi; (US)
Agent: BRINK JR., John D.; (US)
Priority Data:
62/374,353 12.08.2016 US
Title (EN) COMPUTER AIDED DESIGN WITH HIGH RESOLUTION LATTICE STRUCTURES USING GRAPHICS PROCESSING UNITS (GPU)
(FR) CONCEPTION ASSISTÉE PAR ORDINATEUR AVEC STRUCTURES RÉTICULAIRES À HAUTE RÉSOLUTION UTILISANT DES UNITÉS DE TRAITEMENT GRAPHIQUE (GPU)
Abstract: front page image
(EN)A system and method for processing information of a high resolution lattice relating to computer aided design application includes in a first computer processor, tessellating the part surfaces and copying them to a memory associated with a graphics processing unit (GPU). Further processing based on rods is performed on a processor associated with the GPU, wherein processing tasks are subdivided and performed in parallel in a plurality of processing cores of the GPU. Each subdivided processing task may be performed in a separate processing thread allocated to the subtask. The GPU processor produces output based on the further processing and copies the output information to the first computer processor. The first computer processor may perform further processing to the output provided by the GPU.
(FR)L'invention concerne un système et un procédé pour traiter des informations d'une grille à haute résolution en rapport avec une application de conception assistée par ordinateur, comprenant un premier processeur informatique, la tessellation des surfaces partielles et la copie de celles-ci dans une mémoire associée à une unité de traitement graphique (GPU). Un traitement supplémentaire basé sur des tiges est effectué sur un processeur associé à la GPU. Les tâches de traitement sont subdivisées et exécutées en parallèle dans une pluralité de cœurs de traitement de la GPU. Chaque tâche de traitement subdivisée peut être effectuée dans une tâche élémentaire de traitement séparée attribuée à la sous-tâche. Le processeur de la GPU produit une sortie sur la base du traitement supplémentaire et copie les informations de sortie vers le premier processeur d'ordinateur. Le premier processeur d'ordinateur peut effectuer un traitement supplémentaire sur la sortie produite par la GPU.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)