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1. (WO2018013290) METHOD AND APPARATUS FOR DETECTING AND RESOLVING BUS HANG IN A BUS CONTROLLED BY AN INTERFACE CLOCK
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Pub. No.:    WO/2018/013290    International Application No.:    PCT/US2017/037793
Publication Date: 18.01.2018 International Filing Date: 15.06.2017
IPC:
G06F 13/42 (2006.01), G06F 11/07 (2006.01)
Applicants: QUALCOMM INCORPORATED [US/US]; ATTN: International IP Administration 5775 Morehouse Drive San Diego, California 92121-1714 (US)
Inventors: MALIPEDDI, Kiran Kumar; (US).
AMON, Yossi; (US).
ROFF, Graham; (US).
CHUN, Christopher Kong Yee; (US).
CHAVA, Rajesh; (US)
Agent: WIGMORE, Steven P.; (US).
SMITH, Gregory; (US).
BLAHA, Robert; (US).
HARMAN, John; (US).
HOOTS, Matthew; (US).
CRALL, Adam; (US).
DULANEY, Robert; (US).
MAXWELL, Lawrence; (US).
TEMPEL, Michael; (US)
Priority Data:
15/209,416 13.07.2016 US
Title (EN) METHOD AND APPARATUS FOR DETECTING AND RESOLVING BUS HANG IN A BUS CONTROLLED BY AN INTERFACE CLOCK
(FR) PROCÉDÉ ET APPAREIL PERMETTANT DE DÉTECTER ET DE RÉSOUDRE UNE SUSPENSION DE BUS DANS UN BUS COMMANDÉ PAR UNE HORLOGE D'INTERFACE
Abstract: front page image
(EN)Systems and methods are disclosed for resolving bus hang in a computing device. An exemplary system comprises a bus operating in accordance with an interface clock, and a controller in communication with the bus. The controller comprises a finite state machine, where the finite state machine is configured to receive a clock signal from the interface clock and a command signal originating external to the controller. The controller also comprising hang detection logic configured to receive one or more signals that the finite state machine is active, monitor the interface clock, and generate an event notification in response to the interface clock turning off while the finite state machine is active. The controller further comprises a trap handler in communication with the hang detection logic, the trap handler configured to send an interrupt in response to the event notification.
(FR)L'invention concerne des systèmes et des procédés permettant de résoudre une suspension de bus dans un dispositif informatique. Un système donné à titre d'exemple comprend un bus fonctionnant en fonction d'une horloge d'interface, et un dispositif de commande en communication avec le bus. Le dispositif de commande comprend une machine à états finis, la machine à états finis étant configurée de sorte à recevoir un signal d'horloge en provenance de l'horloge d'interface et un signal de commande en provenance de l'extérieur du dispositif de commande. Le dispositif de commande comprend également une logique de détection de suspension configurée de sorte à recevoir un ou plusieurs signaux indiquant que la machine à états finis est active, à surveiller l'horloge d'interface et à générer une notification d'événement à la suite de l'arrêt de l'horloge d'interface pendant que la machine à états finis est active. Le dispositif de commande comprend en outre un gestionnaire de piège en communication avec la logique de détection de suspension, le gestionnaire de piège étant configuré de sorte à envoyer une interruption à la suite de la notification d'événement.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JO, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
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African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)