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1. (WO2018009296) READ FROM MEMORY INSTRUCTIONS, PROCESSORS, METHODS, AND SYSTEMS, THAT DO NOT TAKE EXCEPTION ON DEFECTIVE DATA
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Pub. No.: WO/2018/009296 International Application No.: PCT/US2017/036040
Publication Date: 11.01.2018 International Filing Date: 06.06.2017
IPC:
G06F 13/16 (2006.01) ,G06F 11/07 (2006.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
13
Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
14
Handling requests for interconnection or transfer
16
for access to memory bus
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
11
Error detection; Error correction; Monitoring
07
Responding to the occurrence of a fault, e.g. fault tolerance
Applicants: INTEL CORPORATION[US/US]; 2200 Mission College Boulevard Santa Clara, California 95054, US
Inventors: RAJ, Ashok; US
GABOR, Ron; IL
SHAFI, Hisham; IL
GHETIE, Sergiu; US
KUMAR, Mohan J.; US
YIGZAW, Theodros; US
JAYAKUMAR, Sarathy; US
UPASANI, Neeraj S.; US
Agent: VECCHIA, Brent E.; US
Priority Data:
15/201,43802.07.2016US
Title (EN) READ FROM MEMORY INSTRUCTIONS, PROCESSORS, METHODS, AND SYSTEMS, THAT DO NOT TAKE EXCEPTION ON DEFECTIVE DATA
(FR) LECTURE À PARTIR D'INSTRUCTIONS DE MÉMOIRE, PROCESSEURS, PROCÉDÉS ET SYSTÈMES, QUI NE SONT PAS À L'EXCEPTION DES DONNÉES DÉFECTUEUSES
Abstract:
(EN) A processor of an aspect includes a decode unit to decode a read from memory instruction. The read from memory instruction is to indicate a source memory operand and a destination storage location. The processor also includes an execution unit coupled with the decode unit. The execution unit, in response to the read from memory instruction, is to read data from the source memory operand, store an indication of defective data in an architecturally visible storage location, when the data is defective, and complete execution of the read from memory instruction without causing an exceptional condition, when the data is defective. Other processors, methods, systems, and instructions are disclosed.
(FR) L'invention concerne un processeur d'un aspect comprend une unité de décodage pour décoder une lecture d'une instruction de mémoire. L'invention concerne aussi la lecture à partir de l'instruction de mémoire consiste à indiquer un opérande de mémoire source et un emplacement de stockage de destination. Le processeur comprend également une unité d'exécution couplée à l'unité de décodage. L'unité d'exécution, en réponse à la lecture de l'instruction de mémoire, doit lire des données à partir de l'opérande de mémoire source, stocker une indication de données défectueuses dans un emplacement de stockage visible sur le plan architectural, lorsque les données sont défectueuses, et l'exécution complète de la lecture à partir d'une instruction de mémoire sans provoquer de condition exceptionnelle, lorsque les données sont défectueuses. L'invention concerne également d'autres processeurs, procédés, systèmes et instructions.
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Publication Language: English (EN)
Filing Language: English (EN)