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1. (WO2018006928) TECHNIQUES FOR PERFORMANCE EVALUATION OF AN ELECTRONIC HARDWARE DESIGN ON A COMPUTER SIMULATION SERVER
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Pub. No.:    WO/2018/006928    International Application No.:    PCT/EP2016/065664
Publication Date: 11.01.2018 International Filing Date: 04.07.2016
IPC:
G06F 9/48 (2006.01), G06F 9/52 (2006.01), G06F 17/50 (2006.01)
Applicants: HUAWEI TECHNOLOGIES CO., LTD. [CN/CN]; Huawei Administration Building Bantian Longgang District Shenzhen, Guangdong 518129 (CN).
CHALAK, Ori [IL/DE]; (DE) (US only).
WU, Zuguang [CN/DE]; (DE) (US only).
ZHENG, Libing [CN/DE]; (DE) (US only)
Inventors: CHALAK, Ori; (DE).
WU, Zuguang; (DE).
ZHENG, Libing; (DE)
Agent: KREUZ, Georg; (DE)
Priority Data:
Title (EN) TECHNIQUES FOR PERFORMANCE EVALUATION OF AN ELECTRONIC HARDWARE DESIGN ON A COMPUTER SIMULATION SERVER
(FR) TECHNIQUES D'ÉVALUATION DES PERFORMANCES D'UNE CONCEPTION DE MATÉRIEL ÉLECTRONIQUE SUR UN SERVEUR DE SIMULATION INFORMATIQUE
Abstract: front page image
(EN)The disclosure relates to a method (100) for performance evaluation of an electronic hardware design on a computer simulation server comprising a plurality of processing cores, the method comprising: partitioning (101) a computer simulation (110) of the electronic hardware design among a plurality of worker threads (111, 112, 113) for parallel execution on the plurality of processing cores of the computer simulation server; providing (102) a scheduling element (114) for controlling a progress of the plurality of worker threads (111, 112, 113); and running (103) the scheduling element (114) and the plurality of worker threads (111, 112, 113) on the plurality of processing cores to evaluate a performance of the electronic hardware design on the computer simulation server, wherein an execution of the plurality of worker threads (111, 112, 113) is mutually locked (121, 122) with an execution of the scheduling element (114).
(FR)L'invention concerne un procédé (100) d'évaluation des performances d'une conception de matériel électronique sur un serveur de simulation informatique comprenant une pluralité de cœurs de traitement, le procédé comprenant : la partition (101) d'une simulation informatique (110) de la conception de matériel électronique parmi une pluralité de fils de travail (111, 112, 113) pour une exécution parallèle sur la pluralité de cœurs de traitement du serveur de simulation informatique ; la fourniture (102) d'un élément de planification (114) pour commander la progression de la pluralité de fils de travail (111, 112, 113) ; et l'exécution (103) de l'élément de planification (114) et de la pluralité de fils de travail (111, 112, 113) sur la pluralité de cœurs de traitement pour évaluer une performance de la conception de matériel électronique sur le serveur de simulation informatique, une exécution de la pluralité de fils de travail (111, 112, 113) étant mutuellement verrouillée (121, 122) avec une exécution de l'élément de planification (114).
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)