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1. (WO2017196693) AN APPARATUS FOR HARDWARE ACCELERATED MACHINE LEARNING
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Pub. No.: WO/2017/196693 International Application No.: PCT/US2017/031477
Publication Date: 16.11.2017 International Filing Date: 06.05.2017
IPC:
G06N 99/00 (2010.01) ,G06F 5/01 (2006.01)
Applicants: 1026 LABS, INC.[US/US]; 1711 E. Olive Way, #407 Seattle, Washington 98102, US
Inventors: BRUESTLE, Jeremy; US
NG, Choong; US
Agent: CHEN, Elliott Y.; US
Priority Data:
15/588,55805.05.2017US
62/333,21407.05.2016US
Title (EN) AN APPARATUS FOR HARDWARE ACCELERATED MACHINE LEARNING
(FR) APPAREIL POUR APPRENTISSAGE MACHINE ACCÉLÉRÉ PAR MATÉRIEL
Abstract: front page image
(EN) An architecture and associated techniques of an apparatus for hardware accelerated machine learning are disclosed. The architecture features multiple memory banks storing tensor data. The tensor data may be concurrently fetched by a number of execution units working in parallel. Each operational unit supports an instruction set specific to certain primitive operations for machine learning. An instruction decoder is employed to decode a machine learning instruction and reveal one or more of the primitive operations to be performed by the execution units, as well as the memory addresses of the operands of the primitive operations as stored in the memory banks. The primitive operations, upon performed or executed by the execution units, may generate some output that can be saved into the memory banks. The fetching of the operands and the saving of the output may involve permutation and duplication of the data elements involved.
(FR) L'invention concerne une architecture et des techniques associées d'un appareil pour apprentissage machine accéléré par matériel. L'architecture présente de multiples banques de mémoire stockant des données de tenseur. Les données de tenseur peuvent être extraites simultanément par un certain nombre d'unités d'exécution travaillant en parallèle. Chaque unité de fonctionnement prend en charge un jeu d'instructions spécifiques à certaines opérations primitives pour apprentissage machine. Un décodeur d'instructions est employé pour décoder une instruction d'apprentissage machine et révéler une ou plusieurs des opérations primitives à réaliser par les unités d'exécution, ainsi que les adresses de mémoire des opérandes des opérations primitives telles que stockées dans les banques de mémoire. Les opérations primitives, lorsqu'elles sont réalisées ou exécutées par les unités d'exécution, peuvent produire une certaine sortie qui peut être sauvegardée dans les banques de mémoire. L'extraction des opérandes et l'économie de la sortie peuvent impliquer la permutation et la duplication des éléments de données impliqués.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
African Regional Intellectual Property Organization (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Office (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Publication Language: English (EN)
Filing Language: English (EN)