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1. (WO2017196142) SYSTEM AND METHOD FOR OPTIMIZING DRAM BUS SWITCHING USING LLC
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Pub. No.: WO/2017/196142 International Application No.: PCT/KR2017/004976
Publication Date: 16.11.2017 International Filing Date: 12.05.2017
IPC:
G06F 13/40 (2006.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
13
Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
38
Information transfer, e.g. on bus
40
Bus structure
Applicants: LG ELECTRONICS INC.[KR/KR]; 128, Yeoui-daero Yeongdeungpo-gu Seoul 07336, KR
Inventors: SHAH, Milan; US
AFZAL, Tariq; US
ZOU, Thomas; US
Agent: KIM, Yong In; KR
BAHNG, Hae Cheol; KR
Priority Data:
62/335,65212.05.2016US
Title (EN) SYSTEM AND METHOD FOR OPTIMIZING DRAM BUS SWITCHING USING LLC
(FR) SYSTÈME ET PROCÉDÉ D'OPTIMISATION DE LA COMMUTATION DE BUS DE MÉMOIRE VIVE DYNAMIQUE PAR PROCÉDURE LLC.
Abstract:
(EN) The present disclosure relates to a system and method for optimizing switching of a DRAM bus using LLC. An embodiment of the disclosure includes sending a first type request from a first type queue to the second memory via the memory bus if a direction setting of the memory bus is in a first direction corresponding to the first type request, decrementing a current direction credit count by a first type transaction decrement value, if the decremented current direction credit count is greater than zero, sending another first type request to the second memory via the memory bus and decrementing the current direction credit count again by the first type transaction decrement value, and if the decremented current direction credit count is zero, switching the direction setting of the memory bus to a second direction and resetting the current direction credit count to a second type initial value.
(FR) La présente invention concerne un système et un procédé d'optimisation de la commutation d'un bus de mémoire vive dynamique par une procédure LLC. Un mode de réalisation de l'invention comprend l'émission d'une requête de premier type à partir d'une file d'attente de premier type à la seconde mémoire par l'intermédiaire du bus de mémoire si un réglage de direction du bus de mémoire se trouve dans une première direction correspondant à la requête de premier type, la décrémentation d'une valeur de crédit de direction de courant d'une valeur de décrément de transaction de premier type, si la valeur de crédit de direction de courant décrémentée est supérieure à zéro, l'émission d'une autre requête de premier type à la seconde mémoire par l'intermédiaire du bus de mémoire et la nouvelle décrémentation de la valeur de crédit de direction de courant de la valeur de décrément de transaction de premier type, et si la valeur de crédit de direction de courant décrémentée est égale à zéro, la commutation du réglage de direction du bus de mémoire dans une seconde direction et la remise de la valeur de crédit de direction de courant à une valeur initiale de second type.
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Publication Language: English (EN)
Filing Language: English (EN)