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1. (WO2017192243) FIXED-POINT AND FLOATING-POINT ARITHMETIC OPERATOR CIRCUITS IN SPECIALIZED PROCESSING BLOCKS
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Pub. No.:    WO/2017/192243    International Application No.:    PCT/US2017/026910
Publication Date: 09.11.2017 International Filing Date: 11.04.2017
IPC:
G06F 7/50 (2006.01), G06F 7/485 (2006.01), G06F 7/499 (2006.01)
Applicants: ALTERA CORPORATION [US/US]; 101 Innovation Drive San Jose, CA 95134-1941 (US)
Inventors: LANGHAMMER, Martin; (GB)
Agent: FLETCHER, Michael, G.; (US)
Priority Data:
62/330,933 03.05.2016 US
15/451,467 07.03.2017 US
Title (EN) FIXED-POINT AND FLOATING-POINT ARITHMETIC OPERATOR CIRCUITS IN SPECIALIZED PROCESSING BLOCKS
(FR) CIRCUITS D'OPÉRATEUR ARITHMÉTIQUE À VIRGULE FLOTTANTE ET VIRGULE FIXE DANS DES BLOCS DE TRAITEMENT SPÉCIALISÉS
Abstract: front page image
(EN)The present embodiments relate to circuitry that efficiently performs floating-point arithmetic operations and fixed-point arithmetic operations. Such circuitry may be implemented in specialized processing blocks. If desired, the specialized processing blocks may include configurable interconnect circuitry to support a variety of different use modes. For example, the specialized processing block may efficiently perform a fixed-point or floating-point addition operation or a portion thereof, a fixed-point or floating-point multiplication operation or a portion thereof, a fixed-point or floating-point multiply-add operation or a portion thereof, just to name a few. In some embodiments, two or more specialized processing blocks may be arranged in a cascade chain and perform together more complex operations such as a recursive mode dot product of two vectors of floating-point numbers or a Radix-2 Butterfly circuit, just to name a few.
(FR)L'invention concerne, dans des modes de réalisation, un ensemble de circuits qui réalisent de manière efficace des opérations arithmétiques à virgule flottante et des opérations arithmétiques à virgule fixe. Un tel ensemble de circuits peut être mis en place dans des blocs de traitement spécialisés. Si cela est souhaité, les blocs de traitement spécialisés peuvent comprendre un ensemble de circuits d'interconnexion configurables pour prendre en charge une variété de différents modes d'utilisation. Par exemple, le bloc de traitement spécialisé peut réaliser de manière efficace une opération d'addition à virgule flottante ou une partie de celle-ci, une opération de multiplication à virgule flottante ou virgule fixe ou une partie de celle-ci, une opération de multiplication-addition à virgule flottante ou virgule fixe ou une partie de celle-ci, entre autres. Dans certains modes de réalisation, deux blocs de traitement spécialisés ou plus peuvent être disposés dans une chaîne en cascade et réaliser ensemble des opérations plus complexes tel qu'un produit scalaire en mode récursif de deux vecteurs de nombres à virgule flottante ou un circuit papillon en base 2, entre autres.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)