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1. (WO2017185375) METHOD FOR DATA ACCESS AND MEMORY CONTROLLER
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Pub. No.: WO/2017/185375 International Application No.: PCT/CN2016/080816
Publication Date: 02.11.2017 International Filing Date: 29.04.2016
IPC:
G06F 3/16 (2006.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
3
Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
16
Sound input; Sound output
Applicants: HUAWEI TECHNOLOGIES CO., LTD.[CN/CN]; Huawei Administration Building, Bantian, Longgang District Shenzhen, Guangdong 518129, CN
Inventors: SONG, Kunpeng; CN
CHEN, Yun; CN
QIU, Liangen; CN
Agent: SCIHEAD IP LAW FIRM; Room 1508, Huihua Commercial & Trade Building No. 80, XiAnlie Zhong Road, Yuexiu District Guangzhou, Guangdong 510070, CN
Priority Data:
Title (EN) METHOD FOR DATA ACCESS AND MEMORY CONTROLLER
(FR) PROCÉDÉ POUR UN ACCÈS À DES DONNÉES ET DISPOSITIF DE COMMANDE DE MÉMOIRE
(ZH) 一种数据访问的方法及内存控制器
Abstract:
(EN) Disclosed in the embodiments of the present invention are a method for data access and a memory controller. In the method, a memory controller constructs an advance access command, the advance access command comprising a destination address carried by an access request, then, sends the advance access command to a DDR slave device according to a preset advance amount, the advance access command being used for controlling the DDR slave device to perform the preprocessing procedure for data access; when the memory controller sends a data access command to the DDR slave device, a data transmission link can be started, according to the time of sending the data access command and a preset data access delay time, to complete data access. The present invention can avoid system errors caused by a large delay when the memory controller accesses the DRR slave device on the basis of a DRR bus, improving the efficiency of the memory controller accessing the DRR slave device.
(FR) Conformément à des modes de réalisation, la présente invention concerne un procédé pour un accès à des données et un dispositif de commande de mémoire. Dans le procédé, un dispositif de commande de mémoire construit une instruction d’accès à l’avance, l’instruction d’accès à l’avance comprenant une adresse de destination acheminée par une requête d’accès, puis envoie l’instruction d’accès à l’avance à un dispositif esclave DDR selon une quantité d’avance préétablie, l’instruction d’accès à l’avance étant utilisée pour amener le dispositif esclave DDR à effectuer le procédé de prétraitement pour un accès à des données ; lorsque le dispositif de commande de mémoire envoie une instruction d’accès à des données au dispositif esclave DDR, une liaison de transmission de données peut être démarrée, selon le temps d’envoi de l’instruction d’accès à des données et un temps de retard d’accès à des données préétabli, pour achever un accès à des données. La présente invention peut éviter des erreurs de système provoquées par un grand retard lorsque le dispositif de commande de mémoire accède au dispositif esclave DRR sur la base d’un bus DRR, améliorant l’efficacité d’accès, par le dispositif de commande de mémoire, au dispositif esclave DRR.
(ZH) 本发明实施例公开了一种数据访问的方法及内存控制器,在该方法中,内存控制器构造提前访问命令,提前访问命令中包含访问请求携带的目的地址;然后根据预设提前量向DDR从设备发送提前访问命令,该提前访问命令用于控制DDR从设备执行数据访问的预处理流程;当内存控制器向DDR从设备发送数据访问命令时;可根据数据访问命令的发送时间和预设的数据访问延迟时间启动数据传输链路,完成数据访问。采用本发明,可使得内存控制器基于DDR总线访问DDR从设备时,避免时延过大导致系统出错情况,提高了内存控制器访问DDR从设备的效率。
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Publication Language: Chinese (ZH)
Filing Language: Chinese (ZH)