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1. (WO2017182272) SIGNAL PROCESSING ARRANGEMENT, SENSOR ARRANGEMENT AND SIGNAL PROCESSING METHOD
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Pub. No.:    WO/2017/182272    International Application No.:    PCT/EP2017/058119
Publication Date: 26.10.2017 International Filing Date: 05.04.2017
IPC:
H03M 3/04 (2006.01), H03M 1/12 (2006.01), H03M 1/68 (2006.01)
Applicants: AMS AG [AT/AT]; Schloss Premstätten Tobelbader Str. 30 8141 Premstätten (AT)
Inventors: CHRISTEN, Thomas; (CH).
STEELE, Colin; (GB).
FROEHLICH, Thomas; (CH)
Agent: KAFKA, Veit; Epping Hermann Fischer Patentanwaltsgesellschaft mbH Schloßschmidstr. 5 80639 München (DE)
Priority Data:
16165986.7 19.04.2016 EP
Title (EN) SIGNAL PROCESSING ARRANGEMENT, SENSOR ARRANGEMENT AND SIGNAL PROCESSING METHOD
(FR) AGENCEMENT DE TRAITEMENT DE SIGNAL, AGENCEMENT DE CAPTEUR, ET PROCÉDÉ DE TRAITEMENT DE SIGNAL
Abstract: front page image
(EN)A signal processing arrangement (100) has a signal input (SI) for connecting a capacitive sensor (CS). An amplifier circuit (AMP) is coupled between the signal input (SI) and a feedback point (CB1). A loop filter (LF) is coupled downstream to the feedback point (CB1). A quantizer (QT) is connected downstream to the loop filter (LF) and provides a multi-bit output word (OW). The multi-bit output word (OW) consists of one or more higher significance bits (HSB) and one or more lower significance bits (LSB). A first feedback path (FB1) is coupled between a quantizer (QT) and the feedback point (CB1) for providing a first feedback signal to the feedback point (CB1) being representative of the one or more lower significance bits (LSB). A second feedback path is coupled to the quantizer (QT) for providing a second feedback signal to the signal input (SI) being representative of the one or more higher significance bits (HSB).
(FR)L'invention concerne un agencement de traitement de signal (100) comportant une entrée de signal (SI) destinée à la connexion d'un capteur capacitif (CS). Un circuit amplificateur (AMP) est couplé entre l'entrée de signal (SI) et un point de rétroaction (CB1). Un filtre à boucle (LF) est couplé en aval au point de rétroaction (CB1). Un quantificateur (QT) est connecté en aval au filtre à boucle (LF) et fournit un mot de sortie multibit (OW). Le mot de sortie multibit (OW) est composé d'au moins un bit de signification supérieure (HSB) et d'au moins un bit de signification inférieure (LSB). Un premier trajet de rétroaction (FB1) est couplé entre un quantificateur (QT) et le point de rétroaction (CB1) de façon à fournir un premier signal de rétroaction au point de rétroaction (CB1) qui est représentatif dudit bit de signification inférieure (LSB). Un second trajet de rétroaction est couplé au quantificateur (QT) de façon à fournir un second signal de rétroaction à l'entrée de signal (SI) qui est représentatif dudit bit de signification supérieure (HSB).
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)