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1. (WO2017172255) PROCESSORS, METHODS, SYSTEMS, AND INSTRUCTIONS TO ATOMICALLY STORE TO MEMORY DATA WIDER THAN A NATIVELY SUPPORTED DATA WIDTH
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Pub. No.:    WO/2017/172255    International Application No.:    PCT/US2017/020573
Publication Date: 05.10.2017 International Filing Date: 03.03.2017
IPC:
G06F 9/30 (2006.01)
Applicants: INTEL CORPORATION [US/US]; 2200 Mission College Boulevard Santa Clara, California 95054 (US)
Inventors: SHANBHOGUE, Vedvyas; (US).
ROBINSON, Stephen J.; (US).
BRYANT, Christopher D.; (US).
BRANDT, Jason W.; (US)
Agent: VECCHIA, Brent E.; (US)
Priority Data:
15/089,525 02.04.2016 US
Title (EN) PROCESSORS, METHODS, SYSTEMS, AND INSTRUCTIONS TO ATOMICALLY STORE TO MEMORY DATA WIDER THAN A NATIVELY SUPPORTED DATA WIDTH
(FR) PROCESSEURS, PROCÉDÉS, SYSTÈMES ET INSTRUCTIONS POUR METTRE EN MÉMOIRE DE MANIÈRE ATOMIQUE PLUS DE DONNÉES QU'UNE LARGEUR DE DONNÉES PRISE EN CHARGE DE MANIÈRE NATIVE
Abstract: front page image
(EN)A processor includes a widest set of data registers that corresponds to a given logical processor. Each of the data registers of the widest set have a first width in bits. A decode unit that corresponds to the given logical processor is to decode instructions that specify the data registers of the widest set, and is to decode an atomic store to memory instruction. The atomic store to memory instruction is to indicate data that is to have a second width in bits that is wider than the first width in bits. The atomic store to memory instruction is to indicate memory address information associated with a memory location. An execution unit is coupled with the decode unit. The execution unit, in response to the atomic store to memory instruction, is to atomically store the indicated data to the memory location.
(FR)La présente invention concerne un processeur qui comprend un ensemble le plus large de registres de données correspondant à un processeur logique donné. Chacun des registres de données de l'ensemble le plus large présente une première largeur en bits. Une unité de décodage qui correspond au processeur logique donné est destinée à décoder des instructions qui spécifient les registres de données de l'ensemble le plus large, et doit décoder une instruction de mise en mémoire atomique. L'instruction de mise en mémoire atomique est destinée à indiquer des données qui doivent présenter une seconde largeur en bits qui est plus importante que la première largeur en bits. L'instruction de mise en mémoire atomique est destinée à indiquer des informations d'adresse de mémoire associées à un emplacement de mémoire. Une unité d'exécution est couplée à l'unité de décodage. L'unité d'exécution, en réponse à l'instruction de mise en mémoire atomique, est destinée à mémoriser atomiquement les données indiquées dans l'emplacement de mémoire.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)