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1. (WO2017172032) SYSTEM AND METHOD OF CACHING FOR PIXEL SYNCHRONIZATION-BASED GRAPHICS TECHNIQUES
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Pub. No.: WO/2017/172032 International Application No.: PCT/US2017/016062
Publication Date: 05.10.2017 International Filing Date: 01.02.2017
IPC:
G06T 1/20 (2006.01) ,G06T 1/60 (2006.01) ,G06T 7/507 (2017.01)
Applicants: INTEL CORPORATION[US/US]; 2200 Mission College Boulevard Santa Clara, California 95054, US
Inventors: STRUGAR, Filip; GB
MAMODE, Axel; FR
Agent: KOMENDA, J. Kyle; US
Priority Data:
15/084,80330.03.2016US
Title (EN) SYSTEM AND METHOD OF CACHING FOR PIXEL SYNCHRONIZATION-BASED GRAPHICS TECHNIQUES
(FR) SYSTÈME ET PROCÉDÉ DE MISE EN CACHE POUR DES TECHNIQUES GRAPHIQUES BASÉES SUR LA SYNCHRONISATION DE PIXELS
Abstract: front page image
(EN) Embodiment described herein combines a caching system with special cache flushing methods aimed at reducing thread divergence across a group of threads in a thread group, in order to synchronize branching paths taken by different threads executing on the same graphics processor execution unit, One embodiment provides for a graphics processing apparatus comprising graphics execution logic to execute one or more threads of a graphics shader program; an occluder cache to store input occluder node data for adaptive graphical effects logic of the graphics shader program; and compression logic to compress input occluder node data stored in the occluder cache. The occluder node data, in one embodiment, includes occlusion data for use with adaptive shadowing or transparency logic.
(FR) Un mode de réalisation de l'invention combine un système de mise en cache avec des procédés de vidage de cache spéciaux visant à réduire une divergence de fils à travers un groupe de fils dans un groupe de fils, afin de synchroniser des trajets ramifiés pris par différents fils s'exécutant sur la même unité d'exécution de processeur graphique. Un mode de réalisation concerne un appareil de traitement graphique comprenant une logique d'exécution graphique servant a exécuter un ou plusieurs fils d'un programme nuanceur graphique; un cache d'occulteur servant à stocker des données de nœud occulteur d'entrée pour une logique d'effets graphiques adaptatifs du programme nuanceur graphique; et une logique de compression servant à compresser des données de nœud occulteur d'entrée stockées dans le cache d'occulteur. Les données de nœud occulteur, dans un mode de réalisation, comprennent des données d'occlusion à utiliser avec l'ombrage adaptatif ou la logique de transparence.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
African Regional Intellectual Property Organization (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Office (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (EPO) (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Publication Language: English (EN)
Filing Language: English (EN)