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1. (WO2017157267) RECONFIGURABLE DATA INTERFACE UNIT FOR COMPUTE SYSTEMS
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Pub. No.: WO/2017/157267 International Application No.: PCT/CN2017/076505
Publication Date: 21.09.2017 International Filing Date: 13.03.2017
IPC:
G06F 13/38 (2006.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
13
Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
38
Information transfer, e.g. on bus
Applicants:
HUAWEI TECHNOLOGIES CO., LTD. [CN/CN]; Huawei Administration Building Bantian, Longgang District Shenzhen, Guangdong 518129, CN
Inventors:
WANG, Qiang; US
GU, Zhenguo; US
LI, Qiang; US
WANG, Zhuolei; US
Priority Data:
15/069,70014.03.2016US
Title (EN) RECONFIGURABLE DATA INTERFACE UNIT FOR COMPUTE SYSTEMS
(FR) UNITÉ À INTERFACE DE DONNÉES RECONFIGURABLE POUR SYSTÈMES DE CALCUL
Abstract:
(EN) A system-on-chip includes a reconfigurable data interface to prepare data streams for execution patterns of a processing unit in a flexible compute accelerate system. An apparatus is provided that includes a first set of line buffers configured to store a plurality of data blocks from a memory of a system-on-chip and a field composition circuit configured to generate a plurality of data segments from each of the data blocks. The field composition circuit is reconfigurable to generate the data segments according to a plurality of reconfiguration schemes. The apparatus includes a second set of line buffers configured to communicate with the field composition circuit to store the plurality of data segments for each data block, and a switching circuit configured to generate from the plurality of data segments a plurality of data streams according to an execution pattern of a processing unit of the system-on-chip.
(FR) Selon l'invention, un système sur puce comprend une interface de données reconfigurable servant à préparer des flux de données pour des schémas d'exécution d'une unité de traitement dans un système d'accélération de calcul flexible. Un appareil ci-décrit comprend un premier ensemble de tampons de ligne conçus pour mémoriser une pluralité de blocs de données provenant d'une mémoire d'un système sur puce, et un circuit de composition de champ permettant de générer une pluralité de segments de données à partir de chacun des blocs de données. Le circuit de composition de champ est reconfigurable pour générer les segments de données selon une pluralité de systèmes de reconfiguration. L'appareil comporte un second ensemble de tampons de ligne destinés à communiquer avec le circuit de composition de champ afin de mémoriser la pluralité de segments de données pour chaque bloc de données, et un circuit de commutation prévu pour générer une pluralité de flux de données à partir de la pluralité de segments de données suivant un schéma d'exécution d'une unité de traitement du système sur puce.
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Publication Language: English (EN)
Filing Language: English (EN)