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1. (WO2017156360) TIMING GENERATOR FOR GENERATING HIGH RESOLUTION PULSES HAVING ARBITRARY WIDTHS
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Pub. No.: WO/2017/156360 International Application No.: PCT/US2017/021725
Publication Date: 14.09.2017 International Filing Date: 10.03.2017
IPC:
H03K 5/135 (2006.01) ,H03K 5/133 (2014.01)
[IPC code unknown for H03K 5/135][IPC code unknown for H03K 5/133]
Applicants:
ANALOG DEVICES, INC. [US/US]; One Technology Way Norwood, Massachusetts 02062, US
Inventors:
FOLEY, David P.; US
Agent:
FUNG, Shirley S.; US
Priority Data:
15/066,18210.03.2016US
Title (EN) TIMING GENERATOR FOR GENERATING HIGH RESOLUTION PULSES HAVING ARBITRARY WIDTHS
(FR) GÉNÉRATEUR DE TEMPORISATION POUR GÉNÉRER DES IMPULSIONS À HAUTE RÉSOLUTION AYANT DES LARGEURS ARBITRAIRES
Abstract:
(EN) An exemplary timing generator includes a coarse delay circuit configured to generate a coarse delayed rising edge signal and a coarse delayed falling edge signal from a reference timing signal; a fine delay circuit configured to generate a fine delayed rising edge signal from the coarse delayed rising edge signal and a fine delayed falling edge signal from the coarse delayed falling edge signal; an edge combiner configured to generate the timing signal based on the fine delayed rising edge signal and the fine delayed falling edge signal; and a masking circuit configured to generate a rising edge masking signal and a falling edge masking signal for controlling when the rising edges and the falling edges of the timing signal are generated.
(FR) L'invention concerne un générateur de temporisation à titre d'exemple qui comprend un circuit à retard grossier configuré pour générer un signal de front montant à retard grossier et un signal de front tombant à retard grossier à partir d'un signal de temporisation de référence; un circuit à retard fin configuré pour générer un signal de front montant à retard fin à partir du signal de front montant à retard grossier et un signal de front tombant à retard fin à partir du signal de front tombant à retard grossier; un dispositif de combinaison de fronts configuré pour générer le signal de temporisation sur la base du signal de front montant à retard fin et du signal de front tombant à retard fin; et un circuit de masquage configuré pour générer un signal de masquage de front montant et un signal de masquage de front tombant pour commander le moment où les fronts montants et les fronts tombants du signal de temporisation sont générés.
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Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DJ, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KH, KN, KP, KR, KW, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
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African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Publication Language: English (EN)
Filing Language: English (EN)