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1. (WO2017112269) METHOD AND APPARATUS FOR PARTIAL CACHE LINE SPARING
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Pub. No.: WO/2017/112269 International Application No.: PCT/US2016/063425
Publication Date: 29.06.2017 International Filing Date: 22.11.2016
IPC:
G06F 11/07 (2006.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
11
Error detection; Error correction; Monitoring
07
Responding to the occurrence of a fault, e.g. fault tolerance
Applicants:
INTEL CORPORATION [US/US]; 2200 Mission College Boulevard Santa Clara, California 95054, US
Inventors:
DAS, Debaleena; US
AGARWAL, Rajat; US
MORRIS, Brian S.; US
Agent:
VICTOR, David W.; US
Priority Data:
14/757,90523.12.2015US
Title (EN) METHOD AND APPARATUS FOR PARTIAL CACHE LINE SPARING
(FR) PROCÉDÉ ET APPAREIL DE MISE EN RÉSERVE PARTIELLE DE LIGNE DE MÉMOIRE CACHE
Abstract:
(EN) Provided are an apparatus and method to store data from a cache line at locations having errors in a sparing directory. In response to a write operation having write data for locations in one of the cache lines, the write data for a location in the cache line having an error is written to an entry in a sparing directory including an address of the cache line.
(FR) L'invention concerne un appareil et un procédé permettant de mémoriser des données provenant d'une ligne de mémoire cache dans des emplacements présentant des erreurs dans un répertoire de réserve. En réponse à une opération d'écriture ayant des données d'écriture pour des emplacements dans l'une des lignes de mémoire cache, les données d'écriture pour un emplacement dans la ligne de mémoire cache comportant une erreur sont écrites dans une entrée dans un répertoire de réserve comprenant une adresse de la ligne de mémoire cache.
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Publication Language: English (EN)
Filing Language: English (EN)