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1. (WO2017000119) INITIALIZATION METHOD FOR USE IN I2C SYSTEM AND MASTER DEVICE
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Pub. No.: WO/2017/000119 International Application No.: PCT/CN2015/082650
Publication Date: 05.01.2017 International Filing Date: 29.06.2015
IPC:
G06F 13/42 (2006.01)
G PHYSICS
06
COMPUTING; CALCULATING; COUNTING
F
ELECTRIC DIGITAL DATA PROCESSING
13
Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
38
Information transfer, e.g. on bus
42
Bus transfer protocol, e.g. handshake; Synchronisation
Applicants:
THOMSON LICENSING [FR/FR]; 1-5 Rue Jeanne d'Arc, F-92130 Issy-Les-Moulineaux, FR
Inventors:
SUN, Yiqiang; CN
Agent:
CHINA SCIENCE PATENT & TRADEMARK AGENT LTD.; Suite 4-1105, No. 87, West 3rd Ring North Rd., Haidian District Beijing 100089, CN
Priority Data:
Title (EN) INITIALIZATION METHOD FOR USE IN I2C SYSTEM AND MASTER DEVICE
(FR) PROCÉDÉ D'INITIALISATION DESTINÉ À ÊTRE UTILISÉ DANS UN SYSTÈME I2C ET DISPOSITIF MAÎTRE
Abstract:
(EN) An initialization method for use in an 12C system is suggested. The 12C system comprises at least a master device and a slave device, which are interconnected via an 12C bus comprising a serial clock (SCL) line and a serial data (SDA) line. The method comprises: configuring an SCL pin, which is connected to the SCL line, of the master device to a General Purpose Input Output (GPIO) mode; informing the slave device to release the SDA line by sending a release signal from the SCL pin of the master device; and setting the 12C bus to a START condition by the master device. The present disclosure also provides a master device in the 12C system. The present disclosure can be applied to various 12C systems to improve the initialization process after abnormal termination of communication between a master device and a slave device.
(FR) La présente invention concerne un procédé d'initialisation destiné à être utilisé dans un système I2C. Le système I2C comprend au moins un dispositif maître et un dispositif esclave, qui sont interconnectés par le biais d'un bus I2C comprenant une ligne d'horloge série (SCL pour Serial CLock) et une ligne de données série (SDA pour Serial DAta). Le procédé consiste à : configurer une broche de ligne SCL, qui est raccordée à la ligne SCL, du dispositif maître dans un mode d'entrée/de sortie à usage général (GPIO pour General Purpose Input Output); informer le dispositif esclave de libérer la ligne SDA par envoi d'un signal de libération à partir de la broche de ligne SCL du dispositif maître; et régler le bus I2C à un état de DEBUT au moyen du dispositif maître. La présente invention concerne également un dispositif maître dans le système I2C. La présente invention peut être appliquée à divers systèmes I2C afin d'améliorer le processus d'initialisation après une fin anormale d'une communication entre un dispositif maître et un dispositif esclave.
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African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG)
Publication Language: English (EN)
Filing Language: English (EN)
Also published as:
EP3314449US20180196679