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1. (WO2016097263) ENCODER, DECODER AND ENCODING METHOD WITH LOW ERROR FLOOR
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2016/097263    International Application No.:    PCT/EP2015/080428
Publication Date: 23.06.2016 International Filing Date: 18.12.2015
IPC:
H03M 13/11 (2006.01), H03M 13/27 (2006.01), H03M 13/29 (2006.01)
Applicants: XIEON NETWORKS S.À R.L. [LU/LU]; 6, Route de Trèves 2633 Senningerberg (LU)
Inventors: VON KIRCHBAUER, Heinrich; (DE).
WITTE, Stephan; (DE).
CALABRÒ, Stefano; (DE).
SPINNLER, Bernhard; (DE)
Agent: BOEHMERT & BOEHMERT; Andreas LUCKE Pettenkoferstrasse 20 - 22 80336 Munich (DE)
Priority Data:
14199361.8 19.12.2014 EP
Title (EN) ENCODER, DECODER AND ENCODING METHOD WITH LOW ERROR FLOOR
(FR) CODEUR, DÉCODEUR ET PROCÉDÉ DE CODAGE À FAIBLE PLANCHER D'ERREUR
Abstract: front page image
(EN)Disclosed herein is an encoder for encoding digital data, said encoder comprising one or more component encoders, one or more interconnections between component encoders, one or more inputs and one or more outputs. The encoder is configured to carry out the following steps: -combining internal input bits received via an interconnection and external input bits received via a corresponding input, to assemble a local information word, -encoding the local information word such as to generate a local code word, -outputting a reduced local code word and handing the same reduced local code word over to said interconnect for forwarding said same reduced local code word via said interconnect to another component encoder or to itself, wherein said encoder is configured to forward on each interconnect the bits of the reduced local code in parallel but with delays that are mutually different for at least a subset of the reduced local code word bits.
(FR)L'invention concerne un codeur permettant de coder des données numériques, ledit codeur comprenant un ou plusieurs codeurs de composantes, une ou plusieurs interconnexions entre les codeurs de composantes, une ou plusieurs entrées et une ou plusieurs sorties. Le codeur est configuré pour réaliser les étapes suivantes consistant à : - combiner des bits d'entrée interne reçus par l'intermédiaire d'une interconnexion et des bits d'entrée externe reçus par l'intermédiaire d'une entrée correspondante, pour assembler un mot d'information local, - coder le mot d'information local de manière à générer un mot de code local, - délivrer un mot de code local réduit et transférer ledit même mot de code local réduit vers ladite interconnexion pour transférer ledit même mot de code local réduit par l'intermédiaire de ladite interconnexion vers un autre codeur de composantes ou vers lui-même, ledit codeur étant configuré pour transférer sur chaque interconnexion les bits du code local réduit en parallèle mais avec des retards qui sont différents mutuellement pour au moins un sous-ensemble des bits de mot de code local réduit.
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
Eurasian Patent Organization (AM, AZ, BY, KG, KZ, RU, TJ, TM)
European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)