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1. (WO2016091166) ARITHMETIC CIRCUIT AND DATA TRANSFER METHOD
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2016/091166    International Application No.:    PCT/CN2015/096774
Publication Date: 16.06.2016 International Filing Date: 09.12.2015
IPC:
G06F 13/14 (2006.01)
Applicants: SHANDONG SINOCHIP SEMICONDUCTORS CO., LTD. [CN/CN]; B-2 Qilu Software Plaza 1768 Xinluo Street, New High Tech District Jinan, Shandong 250101 (CN)
Inventors: LIU, Qihao; (CN).
SUN, Xiaoning; (CN).
LIU, Dayou; (CN).
WANG, Yunzhe; (CN).
ZHAO, Yang; (CN)
Agent: PEKSUNG INTELLECTUAL PROPERTY LTD.; 908 Shining Tower 35 Xueyuan Road, Haidian District Beijing 100191 (CN)
Priority Data:
201410749759.X 10.12.2014 CN
Title (EN) ARITHMETIC CIRCUIT AND DATA TRANSFER METHOD
(FR) CIRCUIT ARITHMÉTIQUE ET PROCÉDÉ DE TRANSFERT DE DONNÉES
(ZH) 一种运算电路以及数据转移方法
Abstract: front page image
(EN)Disclosed are an arithmetic circuit and a data transfer method for the arithmetic circuit. The arithmetic circuit comprises: an arithmetic module; a data storage module which comprises at least two memories; and one or more multiplexers which are used for selecting at least one of the at least two memories and for connecting with the at least one selected memory; the arithmetic module is connected with the one or more multiplexers to allow the arithmetic module to be connected to the at least one selected memory through the multiplexers, so that the data transfer is performed between the arithmetic module and the data storage module by the multiplexers during the arithmetic process. The arithmetic circuit has no need of occupying a system bus frequently during the arithmetic process, thus congestion hardly occurs during data storage and high efficiency in operation is guaranteed.
(FR)L'invention concerne un circuit arithmétique et un procédé de transfert de données destiné à ce circuit arithmétique. Ledit circuit arithmétique comprend : un module arithmétique ; un module de mémorisation de données qui comporte au moins deux mémoires ; et un ou plusieurs multiplexeurs qui servent à sélectionner au moins une des mémoires et à se connecter aux mémoires sélectionnées. Le module arithmétique est connecté aux multiplexeurs pour être connecté aux mémoires sélectionnées par l'intermédiaire de ces multiplexeurs, de sorte que le transfert de données soit effectué entre le module arithmétique et le module de mémorisation de données par les multiplexeurs pendant le processus arithmétique. Le circuit arithmétique n'a pas besoin d'occuper fréquemment un bus système pendant le processus arithmétique. De ce fait, il ne se produit presque pas d'encombrement pendant la mémorisation de données, et une grande efficacité de fonctionnement est garantie.
(ZH)一种运算电路以及用于该运算电路的数据转移方法,该运算电路包括:运算模块;数据存储模块,包括至少两个存储器;以及一个或多个多路选择器,用于选择所述至少两个存储器中的至少一个并且连接至所选择的至少一个存储器;其中所述运算模块与所述一个或多个多路选择器相连接,以使所述运算模块能够通过所述多路选择器连接至所选择的至少一个存储器,从而在运算过程中通过所述多路选择器在所述运算模块和所述数据存储模块之间进行数据转移。该运算电路在运算过程中无需频繁占用系统总线,不易造成数据存储时的堵塞,保证了运算的高效性。
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
African Regional Intellectual Property Organization (BW, GH, GM, KE, LR, LS, MW, MZ, NA, RW, SD, SL, ST, SZ, TZ, UG, ZM, ZW)
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European Patent Office (AL, AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, RS, SE, SI, SK, SM, TR)
African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: Chinese (ZH)
Filing Language: Chinese (ZH)