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1. (WO2016061784) SUCCESSIVE APPROXIMATION REGISTER-BASED ANALOG-TO-DIGITAL CONVERTER WITH INCREASED TIME FRAME FOR DIGITAL-TO-ANALOG CAPACITOR SETTLING
Latest bibliographic data on file with the International Bureau   

Pub. No.:    WO/2016/061784    International Application No.:    PCT/CN2014/089275
Publication Date: 28.04.2016 International Filing Date: 23.10.2014
IPC:
H03M 1/38 (2006.01)
Applicants: LATTICE SEMICONDUCTOR CORPORATION [US/US]; 111 SW 5th Avenue Suite 700 Portland, OR 97204 (US)
Inventors: LUO, Kexin; (US).
LIN, Xiaozhi; (US).
PENG, Guofu; (US).
SHEN, Yu; (US).
AHN, Gijung; (US)
Agent: SHANGHAI PATENT & TRADEMARK LAW OFFICE, LLC; 435 Guiping Road Shanghai 200233 (CN)
Priority Data:
Title (EN) SUCCESSIVE APPROXIMATION REGISTER-BASED ANALOG-TO-DIGITAL CONVERTER WITH INCREASED TIME FRAME FOR DIGITAL-TO-ANALOG CAPACITOR SETTLING
(FR) CONVERTISSEUR ANALOGIQUE-NUMÉRIQUE BASÉ SUR UN REGISTRE À APPROXIMATIONS SUCCESSIVES AVEC PLAGE TEMPORELLE AUGMENTÉE POUR LA STABILISATION DES CONDENSATEURS NUMÉRIQUE-ANALOGIQUE
Abstract: front page image
(EN)Successive approximation register (SAR)-based analog-to-digital converters (ADCs) are provided that increase a time frame allocated for the settling of capacitors in a digital-to-analog converter (DAC) capacitor network by feeding a comparator output signal to the DAC to begin DAC capacitor settling before the comparator output is latched by a clock signal at a latching time. An SAR ADC (100) can include a window circuit (138) that provides the comparator output directly from the comparator (120) to the DAC (140) before the latching time of the comparator (120). After the latching time, the latched version of the comparator output is provided to the DAC capacitor (144). By providing the capacitor output to the DAC capacitor (144) before latching, the DAC capacitor (144) can settle earlier compared to the SAR ADC (100) where the DAC capacitor (144) settling begins after the latching time of the comparator (120).
(FR)L'invention concerne des convertisseurs analogique-numérique (CAN) basés sur des registres à approximations successives (SAR), qui augmentent une plage temporelle attribuée à la stabilisation de condensateurs dans un réseau de condensateurs de convertisseur numérique-analogique (CNA) en introduisant un signal de sortie de comparateur dans le CNA pour entamer la stabilisation du condensateur de CNA avant que la sortie de comparateur ne soit verrouillée par un signal d'horloge à un instant de verrouillage. Un CAN (100) à SAR peut comprendre un circuit (138) à fenêtre qui fournit la sortie de comparateur directement du comparateur (120) au CNA (140) avant l'instant de verrouillage du comparateur (120). Après l'instant de verrouillage, la version verrouillée de la sortie de comparateur est fournie au condensateur (144) de CNA. En fournissant la sortie de comparateur au condensateur (144) de CNA avant le verrouillage, le condensateur (144) de CNA peut se stabiliser plus tôt, par comparaison au CAN (100) à SAR où la stabilisation du condensateur (144) de CNA commence après l'instant de verrouillage du comparateur (120).
Designated States: AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BN, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IR, IS, JP, KE, KG, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PA, PE, PG, PH, PL, PT, QA, RO, RS, RU, RW, SA, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
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African Intellectual Property Organization (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, KM, ML, MR, NE, SN, TD, TG).
Publication Language: English (EN)
Filing Language: English (EN)